參數(shù)資料
型號(hào)： 5CGXFC7C7F23C8NES
廠商： Altera
文件頁(yè)數(shù)： 785/1077頁(yè)
文件大?。?/td> 0K
描述： IC CYCLONE V FPGA 150K 484-FBGA
標(biāo)準(zhǔn)包裝： 60
系列： Cyclone® V GX
LAB/CLB數(shù)： 56415
邏輯元件/單元數(shù)： 149500
RAM 位總計(jì)： 6656000
輸入/輸出數(shù)： 240
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-FBGA（23x23）
其它名稱： 544-2741
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cmd register setting: data_expected bit set to 0
cmdarg register settings:
Bit [31] set to 1
Bits [7:2] set to 4
All other bits set to 0
Task file settings:
Command field of the ATA task file set to 0xE0
Reserved fields of the task file set to 0
bytcnt register and block_size field of the blksiz register: set to 16
The FLUSH CACHE EXT Command
For card devices that buffer/cache written data, the FLUSH CACHE EXT command ensures that buffered
data is written to the card media. For cards that do not buffer written data, the FLUSH CACHE EXT command
returns a success status. No data transfer (RW_BLK) is expected for this ATA command.
The host issues a RW_REG command for the ATA command, and the status is retrieved with the SD/SDIO
CMD39 or RW_REG command. There can be error status for this ATA command, in which case fields other
than the status field of the ATA task file are valid.
The host controller uses the following settings while sending the RW_REG command for the STANDBY
IMMEDIATE ATA command:
cmd register setting: data_expected bit set to 0
cmdarg register settings:
Bit [31] set to 1
Bits [7:2] set to 4
All other bits set to 0
Task file settings:
Command field of the ATA task file set to 0xEA
Reserved fields of the task file set to 0
bytcnt register and block_size field of the blksiz register: set to 16
Card Read Threshold
When an application needs to perform a single or multiple block read command, the application must set
the cardthrctl register with the appropriate card read threshold size in the card read threshold field
(cardrdthreshold) and set the cardrdthren bit to 1. This additional information specified in the
controller ensures that the controller sends a read command only if there is space equal to the card read
threshold available in the RX FIFO buffer. This in turn ensures that the card clock is not stopped in the
middle a block of data being transmitted from the card. Set the card read threshold to the block size of the
transfer to guarantee there is a minimum of one block size of space in the RX FIFO buffer before the controller
enables the card clock.
The card read threshold is required when the round trip delay is greater than half of sdmmc_clk_divided.
Altera Corporation
SD/MMC Controller
11-57
The FLUSH CACHE EXT Command
cv_54011
2013.12.30
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PDF描述
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5CGXFC7D6F27C7NES 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V GX 5648 LABs 336 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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