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參數(shù)資料
| 型號： | 552CD000201BG |
| 廠商： | SILICON LABORATORIES |
| 元件分類： | VCXO, clock |
| 英文描述： | VCXO, CLOCK, 71.68 MHz, CMOS OUTPUT |
| 封裝： | ROHS COMPLIANT, SMD, 6 PIN |
| 文件頁數(shù)： | 34/80頁 |
| 文件大?。?/td> | 3734K |
| 代理商： | 552CD000201BG |
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Si552
4
Rev. 0.5
Table 5. CLK± Output Phase Jitter
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
Phase Jitter (RMS)1,2,3
for FOUT > 500 MHz
φ
J
Kv = 45 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.35
0.38
—
ps
Kv = 90 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.43
0.41
—
Kv = 135 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.52
0.46
—
Kv = 180 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.64
0.52
—
Phase Jitter (RMS)1,2,3
for FOUT of 125 to 500 MHz
φ
J
Kv = 45 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.42
0.58
—
ps
Kv = 90 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.48
0.60
—
Kv = 135 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.57
0.64
—
Kv = 180 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.67
0.68
—
Notes:
1. Differential Modes: LVPECL/LVDS/CML. Refer to AN255, AN256, and AN266 for further information.
2. For best jitter and phase noise performance, always choose the smallest KV that meets the application’s minimum APR
requirements. See “AN266: VCXO Tuning Slope (KV), Stability, and Absolute Pull Range (APR)” for more information.
3. See “AN255: Replacing 622 MHz VCSO devices with the Si550 VCXO” for comparison highlighting power supply
rejection (PSR) advantage of Si55x versus SAW-based solutions.
Table 6. CLK± Output Period Jitter
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
Period Jitter*
for FOUT < 160 MHz
JPER
RMS
—
2
—
ps
Peak-to-Peak
—
14
—
*Note: Any output mode, including CMOS, LVPECL, LVDS, CML. N = 1000 cycles. Refer to AN279 for further information.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 552CD000202BGR | VCXO, CLOCK, 74.88 MHz, CMOS OUTPUT |
| 554CE000259BG | VCXO, CLOCK, 84.375 MHz, CMOS OUTPUT |
| 550AE19M4400BG | VCXO, CLOCK, 19.44 MHz, LVPECL OUTPUT |
| 552AD000107BG | VCXO, CLOCK, 669.32658 MHz, LVPECL OUTPUT |
| 552AD000253BG | VCXO, CLOCK, 176.83816 MHz, LVPECL OUTPUT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 552CD000230DG | 制造商:Silicon Laboratories Inc 功能描述:CNTRLD OSC 22.5792MHZ/24.576MHZ VCXO CMOS 6PIN - Trays |
| 552CD000230DGR | 制造商:Silicon Laboratories Inc 功能描述:CNTRLD OSC 22.5792MHZ/24.576MHZ VCXO CMOS 6PIN - Tape and Reel |
| 552CD000260DG | 制造商:Silicon Laboratories Inc 功能描述: |
| 552CD000270DG | 制造商:Silicon Laboratories Inc 功能描述: |
| 552CD000270DGR | 制造商:Silicon Laboratories Inc 功能描述:CONTROLLED OSCILLATOR 148.351648MHZ/148.5MHZ VCXO CMOS 6-PIN - Tape and Reel |
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