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參數(shù)資料
| 型號： | XCR3256XL-7PQ256C |
| 廠商： | Xilinx, Inc. |
| 英文描述： | 256 Macrocell CPLD |
| 中文描述： | 256個宏單元CPLD |
| 文件頁數(shù)： | 2/10頁 |
| 文件大?。?/td> | 257K |
| 代理商： | XCR3256XL-7PQ256C |
XCR3256XL 256 Macrocell CPLD
2
1-800-255-7778Preliminary Product SpecificationR
DC Electrical Characteristics Over Recommended Operating Conditions
(1)
Figure 1:
XCR3256XL Typical I
CC
vs. Frequency at V
CC
= 3.3V, 25
°
C
Table 1:
Typical I
CC
vs. Frequency at V
CC
= 3.3V, 25
°
C
Frequency (MHz)
0
1
10
20
40
60
80
100
120
140
Typical I
CC
(mA)
0.02
0.91
8.87
17.7
34.8
51.5
68
84.2
100.1
116.6
Symbol
Parameter
Test Conditions
Min.
Max.
Unit
V
OH
Output High voltage for 3.3V outputs
I
OH
=
–
8 mA
2.4
-
V
V
OL
Output Low voltage for 3.3V outputs
I
OL
= 8 mA
-
0.4
V
I
IL
Input leakage current
V
IN
= GND or V
CC
–
10
10
m
A
I
IH
I/O High-Z leakage current
V
IN
= GND or V
CC
–
10
10
m
A
I
CCSB
Standby current
V
CC
= 3.6V
-
100
m
A
I
CC
Dynamic current
(2,3)
f = 1 MHz
-
2
mA
f = 50 MHz
-
60
mA
C
IN
Input pin capacitance
(4)
f = 1 MHz
-
8
pF
C
CLK
Clock input capacitance
(4)
f = 1 MHz
5
12
pF
C
I/O
I/O pin capacitance
(4)
f = 1 MHz
-
10
pF
Notes:
1.
2.
3.
See XPLA3 family data sheet (DS012) for recommended operating conditions.
See
Table 1
, Figure1 for typical values.
This parameter measured with a 16-bit, loadable up/down counter loaded into every logic block, with all outputs disabled and
unloaded. Inputs are tied to V
CC
or ground. This parameter guaranteed by design and characterization, not testing.
Typical values not tested.
4.
0
20
40
60
80
100
120
140
0
20
40
60
80
100
120
140
160
Frequency (MHz)
T
相關PDF資料 |
PDF描述 |
|---|---|
| XCR3256XL-7PQ256I | 256 Macrocell CPLD |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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