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參數資料
| 型號： | XCB56364PV100 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 8-BIT, 100 MHz, OTHER DSP, PQFP112 |
| 封裝： | QFP-112 |
| 文件頁數： | 42/162頁 |
| 文件大小： | 2405K |
| 代理商： | XCB56364PV100 |
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Specifications
External Memory Expansion Port (Port A)
2-22
DSP56364 Advance Information
MOTOROLA
Table 2-9 DRAM Page Mode Timings, One Wait State (Low-Power Applications)
1, 2, 3
No.
Characteristics
Symbol
Expression
20 MHz
6
30 MHz
6
Unit
Min
Max
Min
Max
131
Page mode cycle time for two
consecutive accesses of the
same direction
t
PC
2
×
T
C
100.0
—
66.7
—
ns
Page mode cycle time for
mixed (read and write)
accesses
1.25
×
T
C
62.5
—
41.7
—
132
CAS assertion to data valid
(read)
t
CAC
T
C
7.5
—
42.5
—
25.8
ns
133
Column address valid to data
valid (read)
t
AA
1.5
×
T
C
7.5
—
67.5
—
42.5
ns
134
CAS deassertion to data not
valid (read hold time)
t
OFF
0.0
—
0.0
—
ns
135
Last CAS assertion to RAS
deassertion
t
RSH
0.75
×
T
C
4.0
33.5
—
21.0
—
ns
136
Previous CAS deassertion to
RAS deassertion
t
RHCP
2
×
T
C
4.0
96.0
—
62.7
—
ns
137
CAS assertion pulse width
t
CAS
0.75
×
T
C
4.0
33.5
—
21.0
—
ns
138
Last CAS deassertion to RAS
deassertion
4
BRW[1:0] = 00
t
CRP
1.75
×
T
C
6.0
81.5
—
52.3
—
ns
BRW[1:0] = 01
3.25
×
T
C
6.0
156.5
102.2
—
ns
BRW[1:0] = 10
4.25
×
T
C
6.0
206.5
135.5
—
ns
BRW[1:0] = 11
6.25
×
T
C
– 6.0
306.5
—
202.1
—
ns
139
CAS deassertion pulse width
t
CP
0.5
×
T
C
4.0
21.0
—
12.7
—
ns
140
Column address valid to CAS
assertion
t
ASC
0.5
×
T
C
4.0
21.0
—
12.7
—
ns
141
CAS assertion to column
address not valid
t
CAH
0.75
×
T
C
4.0
33.5
—
21.0
—
ns
142
Last column address valid to
RAS deassertion
t
RAL
2
×
T
C
4.0
96.0
—
62.7
—
ns
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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