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參數(shù)資料
| 型號： | XCB56364PV100 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 8-BIT, 100 MHz, OTHER DSP, PQFP112 |
| 封裝： | QFP-112 |
| 文件頁數(shù)： | 28/162頁 |
| 文件大?。?/td> | 2405K |
| 代理商： | XCB56364PV100 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁當(dāng)前第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁
Specifications
Reset, Stop, Mode Select, and Interrupt Timing
2-8
DSP56364 Advance Information
MOTOROLA
2.9
RESET, STOP, MODE SELECT, AND INTERRUPT TIMING
Table 2-7 Reset, Stop, Mode Select, and Interrupt Timing
6
No.
Characteristics
Expression
Min
Max
Unit
8
Delay from
RESET
assertion to all pins at reset
value
3
—
—
26.0
ns
9
Required
RESET
duration
4
Power on, external clock generator, PLL
disabled
50
×
ET
C
500.0
—
ns
Power on, external clock generator, PLL
enabled
1000
×
ET
C
10.0
—
ns
Power on, internal oscillator
75000
×
ET
C
0.75
—
μ
s
During STOP, XTAL disabled
(PCTL Bit 16 = 0)
75000
×
ET
C
0.75
—
ms
During STOP, XTAL enabled
(PCTL Bit 16 = 1)
2.5
×
T
C
25.0
—
ms
During normal operation
2.5
×
T
C
25.0
—
ns
10
Delay from asynchronous
RESET
deassertion
to first external address output (internal reset
deassertion)
5
Minimum
3.25
×
T
C
+ 2.0
34.5
—
ns
Maximum
20.25 T
C
+ 7.50
—
211.5
ns
13
Mode select setup time
30.0
—
ns
14
Mode select hold time
0.0
—
ns
15
Minimum edge-triggered interrupt request
assertion width
6.6
—
ns
16
Minimum edge-triggered interrupt request deas-
sertion width
6.6
—
ns
17
Delay from
IRQA
,
IRQB
,
IRQD
,
NMI
asser-
tion to external memory access address out
valid
Caused by first interrupt instruction fetch
4.25
×
T
C
+ 2.0
44.5
—
ns
Caused by first interrupt instruction
execution
7.25
×
T
C
+ 2.0
74.5
—
ns
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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