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參數(shù)資料
| 型號： | XCB56364PV100 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 8-BIT, 100 MHz, OTHER DSP, PQFP112 |
| 封裝： | QFP-112 |
| 文件頁數(shù)： | 27/162頁 |
| 文件大小： | 2405K |
| 代理商： | XCB56364PV100 |
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Specifications
Phase Lock Loop (PLL) Characteristics
MOTOROLA
DSP56364 Advance Information
2-7
2.8
PHASE LOCK LOOP (PLL) CHARACTERISTICS
Table 2-6 PLL Characteristics
Characteristics
Min
Max
Unit
V
CO
frequency when PLL enabled
(MF
×
E
f
×
2/PDF)
30
200
MHz
PLL external capacitor (PCAP pin to V
CCP
)
(C
PCAP1)
pF
@ MF
≤
4
(MF
×
580)
100
(MF
×
780)
140
@ MF > 4
MF
×
830
MF
×
1470
Notes:
1.
C
PCAP
is the value of the PLL capacitor (connected between the PCAP pin and V
CCP
). The
recommended value in pF for C
PCAP
can be computed from one of the following equations:
(MF x 680)-120
, for MF
≤
4, or
MF x 1100
, for MF > 4.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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