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參數(shù)資料
| 型號： | XCB56364PV100 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 8-BIT, 100 MHz, OTHER DSP, PQFP112 |
| 封裝： | QFP-112 |
| 文件頁數(shù)： | 2/162頁 |
| 文件大?。?/td> | 2405K |
| 代理商： | XCB56364PV100 |
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Overview
Features
2
DSP56364 Advance Information
MOTOROLA
Figure 1 DSP56364 Block Diagram
1
Features
1.1
Digital Signal Processing Core
100 Million Instructions Per Second (MIPS) with an 100 MHz clock at 3.3V.
Object Code Compatible with the 56000 core.
Data ALU with a 24 x 24 bit multiplier-accumulator and a 56-bit barrel shifter. 16-bit arithmetic support.
Program Control with position independent code support and instruction cache support.
Six-channel DMA controller.
PLL based clocking with a wide range of frequency multiplications (1 to 4096), predivider factors (1
to 16) and power saving clock divider (2
i
: i=0 to 7). Reduces clock noise.
Internal address tracing support and OnCE
for Hardware/Software debugging.
CLOCK
INTERNAL
DATA BUS
SWITCH
EXTAL
PROGRAM RAM
0.5K x 24
PROGRAM ROM
8K x 24
Bootstrap ROM
192 x 24
PROGRAM
INTERRUPT
CONT
PROGRAM
DECODE
CONT
PROGRAM
ADDRESS
GEN
YAB
XAB
PAB
DAB
YDB
XDB
PDB
GDB
MODA/IRQA
MODB/IRQB
MODD/IRQD
DATA ALU
24 X 24+56
56-BIT MAC
TWO 56-BIT
ACCUMULATORS
BARREL SHIFTER
PLL
ADDRESS
GENERATION UNIT
SIX CHANNELS
DMA UNIT
OnCE
DSP56300
CORE
GPIO
ESAI
12
4
24-BIT
X
MEMORY
RAM
1K X 24
Y
MEMORY
RAM
1.5K X 24
DDB
Y
X
P
P
24 BITS BUS
SHI
JTAG
4
5
RESET
PINIT/NMI
POWER
MGMT
DRAM & SRAM
BUS
INTERFACE
EXTERNAL
ADDRESS BUS
SWITCH
EXTERNAL
DATA BUS
SWITCH
ADDRESS
18
6
DATA
CONTROL
8
PERIPHERAL
EXPANSION
AREA
MEMORY
EXPANSION
AREA
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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