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參數(shù)資料
| 型號(hào)： | XC5202-5PC84C |
| 廠商： | XILINX INC |
| 元件分類(lèi)： | FPGA |
| 英文描述： | Field Programmable Gate Arrays |
| 中文描述： | FPGA, 64 CLBS, 2000 GATES, 83 MHz, PQCC84 |
| 封裝： | PLASTIC, LCC-84 |
| 文件頁(yè)數(shù)： | 65/73頁(yè) |
| 文件大?。?/td> | 598K |
| 代理商： | XC5202-5PC84C |
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R
November 5, 1998 (Version 5.2)
7-147
XC5200 Series Field Programmable Gate Arrays
7
Additional No Connect (N.C.) Connections for PQ208 and PQ240 Packages
Notes:
* Pins labeled VCC* are internally bonded to a VCC plane within the BG225 package. The external pins are: B2, D8, H15, R8,
B14, R1, H1, and R15.
Pins labeled GND* are internally bonded to a ground plane within the BG225 package. The external pins are: A1, D12, G7,
G9, H6, H8, H10, J8, K8, A8, F8, G8, H2, H7, H9, J7, J9, M8.
Boundary Scan Bit 0 = TDO.T
Boundary Scan Bit 1 = TDO.O
Boundary Scan Bit 1056 = BSCAN.UPD
Pin Locations for XC5215 Devices
The following table may contain pinout information for unsupported device/package combinations. Please see the
availability charts elsewhere in the XC5200 Series data sheet for availability information.
180.
181.
182.
183.
184.
I/O
I/O
I/O
I/O
I/O
-
GND
I/O
I/O
I/O
I/O
VCC
I/O (A4)
I/O (A5)
I/O
I/O
I/O
I/O
I/O (A6)
I/O (A7)
GND
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
N4
P2
T1
R1
N2
-
M3
P1
N1
M4
L4
-
M2
M1
L3
L2
L1
K1
K2
K3
K4
D11
A12
C11
B11
E10
GND*
-
A11
D10
C10
B10
VCC*
A10
D9
C9
B9
A9
E9
C8
B8
GND*
190
191
192
193
194
39
42
45
51
54
-
-
57
66
69
75
-
78
81
87
90
93
99
102
105
-
117
-
-
-
-
118
119
120
-
-
-
121
122
-
-
123
124
125
126
127
129
130
-
-
-
131
132
133
-
-
-
134
135
-
136
137
138
139
140
141
141
142
-
-
-
143
144
145
-
-
-
146
147
148
149
150
151
152
153
154
167
168
169
170
-
171
172
173
-
-
-
174
175
176
177
178
179
180
181
182
196
197
198
199
200
201
202
203
205
206
207
208
209
210
211
185.
186.
187.
188.
189.
190.
191.
192.
193.
194.
195.
196.
81
82
-
-
-
-
83
84
1
PQ208
105
107
155
156
PQ240
1
3
51
52
53
54
102
104
157
158
206
207
208
22
37
83
98
143
158
195
204
219
Pin
Description
PC84
TQ144
PQ160
TQ176
PQ208
PG223
BG225
PQ240
Boundary Scan
Order
Pin
Description
PQ160
142
143
144
145
146
-
-
147
HQ208
183
184
185
186
187
188
189
190
HQ240
212
213
214
215
216
217
218
220
PG299
K1
K2
K3
K5
K4
J1
J2
H1
BG225
VCC*
E8
B7
A7
C7
D7
E7
A6
BG352
VCC*
D14
C14
A15
B15
C15
D15
A16
Boundary Scan Order
-
138
141
147
150
153
159
162
VCC
I/O (A8)
I/O (A9)
I/O
I/O
I/O
I/O
I/O (A10)
1.
2.
3.
4.
5.
6.
7.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC5202-5PQ160C | Field Programmable Gate Arrays |
| XC5202-5PQ208C | Field Programmable Gate Arrays |
| XC5202-5PQ240C | Field Programmable Gate Arrays |
| XC5202-5TQ144C | Field Programmable Gate Arrays |
| XC5202-5TQ176C | Field Programmable Gate Arrays |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XC5202-5PG156I | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| XC5202-5PG191C | 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:Field Programmable Gate Arrays |
| XC5202-5PG223C | 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:Field Programmable Gate Arrays |
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