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參數(shù)資料
| 型號： | XC3164A-3PQ160C |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| 中文描述： | FPGA, 224 CLBS, 3500 GATES, 270 MHz, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 39/50頁 |
| 文件大?。?/td> | 474K |
| 代理商： | XC3164A-3PQ160C |
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2-141
68 PLCC
XC3020
XC3030
10
11
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—
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—
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—
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XC3020
10
11
—
12
13
—
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—
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—
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29
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31
XC3030, XC3042
PWRDN
TCLKIN-I/O
I/O*
I/O
I/O
I/O
I/O
I/O
I/O
I/O
VCC
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
M1-RDATA
M0-RTRIG
M2-I/O
HDC-I/O
I/O
LDC-I/O
I/O
I/O
*
I/O
I/O
I/O*
INIT-I/O
GND
I/O
I/O
I/O
I/O
I/O
I/O
I/O*
I/O*
I/O
XTL2(IN)-I/O
84 PLCC
12
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48
49
50
51
52
53
84 PGA
B2
C2
B1
C1
D2
D1
E3
E2
E1
F2
F3
G3
G1
G2
F1
H1
H2
J1
K1
J2
L1
K2
K3
L2
L3
K4
L4
J5
K5
L5
K6
J6
J7
L7
K7
L6
L8
K8
L9
L10
K9
L11
32
33
—
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36
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38
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40
41
42
43
68 PLCC
XC3030
XC3020
44
45
46
47
48
—
49
50
51
—
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53
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—
—
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—
—
65
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68
1
2
3
4
5
—
—
6
7
8
9
XC3020
XC3030, XC3042
RESET
DONE-PG
D7-I/O
XTL1(OUT)-BCLKIN-I/O
D6-I/O
I/O
D5-I/O
CS0-I/O
D4-I/O
I/O
VCC
D3-I/O
CS1-I/O
D2-I/O
I/O
I/O*
D1-I/O
RDY/BUSY-RCLK-I/O
D0-DIN-I/O
DOUT-I/O
CCLK
A0-WS-I/O
A1-CS2-I/O
A2-I/O
A3-I/O
I/O*
I/O*
A15-I/O
A4-I/O
A14-I/O
A5-I/O
GND
A13-I/O
A6-I/O
A12-I/O
A7-I/O
I/O*
I/O*
A11-I/O
A8-I/O
A10-I/O
A9-I/O
84 PLCC
54
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58
59
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84
1
2
3
4
5
6
7
8
9
10
11
84 PGA
K10
J10
K11
J11
H10
H11
F10
G10
G11
G9
F9
F11
E11
E10
E9
D11
D10
C11
B11
C10
A11
B10
B9
A10
A9
B8
A8
B6
B7
A7
C7
C6
A6
A5
B5
C5
A4
B4
A3
A2
B3
A1
Unprogrammed IOBs have a default pull-up. This prevents an undefined pad level for unbonded or unused IOBs. Programmed
outputs are default slew-rate limited.
This table describes the pinouts of three different chips in three different packages. The pin-description column lists 84 of the 118
pads on the XC3042 (and 84 of the 98 pads on the XC3030) that are connected to the 84 package pins. Ten pads, indicated by an
asterisk, do not exist on the XC3020, which has 74 pads; therefore the corresponding pins on the 84-pin packages have no
connections to an XC3020. Six pads on the XC3020 and 16 pads on the XC3030, indicated by a dash (—) in the 68 PLCC column,
have no connection to the 68 PLCC, but are connected to the 84-pin packages.
XC3000 Families 68-Pin PLCC, 84-Pin PLCC and PGA Pinouts
XC3000, XC3000A, XC3000L, XC3100 and XC3100A families have identical pinouts
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC3164A-3PQ160I | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-3TQ144C | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-3TQ144I | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-4PC84C | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-4PC84I | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC3164A-3PQ160I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-3TQ144C | 功能描述:IC FPGA 224 CLB'S 144-TQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:XC3000A/L 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55） |
| XC3164A-3TQ144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3164A-4PC84C | 制造商:Xilinx 功能描述:XLXXC3164A-4PC84C IC SYSTEM GATE |
| XC3164A-4PC84I | 制造商:Xilinx 功能描述: |
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