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參數(shù)資料
| 型號(hào)： | XC17256DDD8M |
| 廠商： | XILINX INC |
| 元件分類： | DRAM |
| 英文描述： | QPRO Family of XC1700D QML Configuration PROMs |
| 中文描述： | 256K X 1 CONFIGURATION MEMORY, CDIP8 |
| 封裝： | CERAMIC, DIP-8 |
| 文件頁數(shù)： | 4/10頁 |
| 文件大小： | 103K |
| 代理商： | XC17256DDD8M |
R
Figure 2:
Master Serial Mode.
The one-time-programmable PROM supports automatic loading of configuration programs.
Multiple devices can be cascaded to support additional FPGAs. An early DONE inhibits the PROM data output one CCLK
cycle before the FPGA I/Os become active.
DIN
DOUT
CCLK
INIT
DONE
PROM
DATA
CLK
CE
CE
FPGA
(Low Resets the Address Pointer)
* For mode pin connections,
refer to the appropriate FPGA data sheet.
Vcc
VCC
VCC
OPTIONAL
Daisy-chained
FPGAs with
Different
configurations
OPTIONAL
Slave FPGAs
with Identical
Configurations
RESET
RESET
DS027_02_052200
CCLK
(Output)
DIN
DOUT
(Output)
OE/RESET
MODES*
VPP
VPP
Cascaded
Serial
Memory
DATA
CLK
CEO
OE/RESET
3.3V
4.7K
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC1736DDD8M | QPRO Family of XC1700D QML Configuration PROMs |
| XC1765DDD8M | QPRO Family of XC1700D QML Configuration PROMs |
| XC1700E | Configuration PROMs |
| XC1701LPC20C | Configuration PROMs |
| XC1701LPC20I | Configuration PROMs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XC17256D-PC20I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Configuration EPROM |
| XC17256D-PD8C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Configuration EPROM |
| XC17256D-PD8I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Configuration EPROM |
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