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參數(shù)資料
| 型號(hào)： | UPD78F0034BGB-8EU-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, PLASTIC, LQFP-64 |
| 文件頁數(shù)： | 168/592頁 |
| 文件大小： | 3447K |
| 代理商： | UPD78F0034BGB-8EU-A |
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25
User’s Manual U14046EJ3V0UD
LIST OF FIGURES (3/8)
Figure No.
Title
Page
8-18
Timing of Pulse Width Measurement Operation with Free-Running Counter
(with Both Edges Specified) .................................................................................................................
202
8-19
Control Register Settings for Pulse Width Measurement with Free-Running Counter
and Two Capture Registers .................................................................................................................
203
8-20
Timing of Pulse Width Measurement Operation with Free-Running Counter
and Two Capture Registers (with Rising Edge Specified) ...................................................................
204
8-21
Control Register Settings for Pulse Width Measurement by Means of Restart ...................................
205
8-22
Timing of Pulse Width Measurement Operation by Means of Restart (with Rising Edge Specified) ...
205
8-23
Control Register Settings in Square-Wave Output Mode ....................................................................
206
8-24
Square-Wave Output Operation Timing ...............................................................................................
206
8-25
Control Register Settings for PPG Output Operation ..........................................................................
207
8-26
PPG Output Configuration Diagram ....................................................................................................
208
8-27
PPG Output Operation Timing .............................................................................................................
208
8-28
Start Timing of 16-Bit Timer Counter 0 (TM0) ......................................................................................
216
8-29
Capture Register Data Retention Timing .............................................................................................
216
8-30
Operation Timing of OVF0 Flag ...........................................................................................................
217
8-31
CR01 Capture Operation with Rising Edge Specified .........................................................................
218
9-1
Block Diagram of 8-Bit Timer/Event Counter 50 ..................................................................................
220
9-2
Block Diagram of 8-Bit Timer/Event Counter 51 ..................................................................................
220
9-3
Format of Timer Clock Select Register 50 (TCL50) .............................................................................
222
9-4
Format of Timer Clock Select Register 51 (TCL51) .............................................................................
223
9-5
Format of 8-Bit Timer Mode Control Register 50 (TMC50) ..................................................................
224
9-6
Format of 8-Bit Timer Mode Control Register 51 (TMC51) ..................................................................
225
9-7
Format of Port Mode Register 7 (PM7) ................................................................................................
226
9-8
Interval Timer Operation Timing ...........................................................................................................
228
9-9
External Event Counter Operation Timing (with Rising Edge Specified) .............................................
231
9-10
Square-Wave Output Operation Timing ...............................................................................................
233
9-11
PWM Output Operation Timing ............................................................................................................
235
9-12
Timing of Operation by Change of CR5n .............................................................................................
236
9-13
16-Bit Resolution Cascade Connection Mode .....................................................................................
237
9-14
Start Timing of 8-Bit Timer Counter 5n (TM5n) ....................................................................................
241
10-1
Watch Timer Block Diagram ................................................................................................................
242
10-2
Format of Watch Timer Operation Mode Register (WTM) ...................................................................
244
10-3
Operation Timing of Watch Timer/Interval Timer ..................................................................................
246
11-1
Watchdog Timer Block Diagram ..........................................................................................................
247
11-2
Format of Watchdog Timer Clock Select Register (WDCS) .................................................................
248
11-3
Format of Watchdog Timer Mode Register (WDTM) ...........................................................................
249
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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