參數(shù)資料
型號(hào)： TMX320C6454ZTZ8
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點(diǎn)數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 4/225頁(yè)
文件大小： 1663K
代理商： TMX320C6454ZTZ8
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www.ti.com
P
1.3
Functional Block Diagram
L
(
B
DDR2
Mem Ctlr
S
(
C64x+ DSP Core
Data Path B
B Register File
B31B16
B15B0
Instruction Fetch
Data Path A
A Register File
A31A16
A15A0
Device
Configuration
Logic
.L1
.S1
.M1
xx
xx
.D1
.D2
.M2
xx
xx
.S2
.L2
64
SBSRAM
SRAM
L1P Cache Direct-Mapped
32K Bytes
L1D Cache
2-Way
Set-Associative
32K Bytes Total
C6454
P
PLL1 and
PLL1
Controller
EMIFA
ZBT SRAM
HI
LO
Boot Configuration
ROM/FLASH
I/O Devices
I2C
GPIO16
(B)
16
McBSP0
(A)
I
(
M
e
g
a
m
o
d
u
l
e
L2
Cache
Memory
1048K
Bytes
L1P Memory Controller (Memory Protect/Bandwidth Mgmt)
McBSP1
(A)
HPI (32/16)
(B)
Instruction
Decode
16-/32-bit
Instruction Dispatch
Control Registers
In-Circuit Emulation
DDR2 SDRAM
32
Timer1
(C)
HI
LO
Timer0
(C)
PLL2 and
PLL2
Controller
(D)
EMAC
10/100/1000
MII
SPLOOP Buffer
P
L1D Memory Controller (Memory Protect/Bandwidth Mgmt)
I
EDMA 3.0
L2 ROM
32K
Bytes
(E)
Secondary
Switched Central
Resource
A.
B.
McBSPs: Framing Chips H.100, MVIP, SCSA, T1, E1; AC97 Devices; SPI Devices; Codecs
The PCI peripheral pins are muxed with some of the HPI peripheral pins. For more detailed information, see the
Device Configuration
section
of this document.
Each of the TIMER peripherals (TIMER1 and TIMER0) is configurable as either two 64-bit general-purpose timers
or
two 32-bit general-purpose
timers
or
a watchdog timer.
The PLL2 controller also generates clocks for the EMAC.
When accessing the internal ROM of the DSP, the CPU frequency must always be less than 750 MHz.
C.
D.
E.
MDIO
RMGII
(D)
GMII
RMII
PCI66
(B)
TMS320C6454
Fixed-Point Digital Signal Processor
SPRS311A–APRIL 2006–REVISED DECEMBER 2006
Figure 1-2
shows the functional block diagram of the C6454 device.
Figure 1-2. Functional Block Diagram
TMS320C6454 Fixed-Point Digital Signal Processor
4
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