參數(shù)資料
型號(hào)： TMR320R2811ZHHA
廠商： Texas Instruments, Inc.
英文描述： MAGNIFIER PROVUE ILLUMINATED COP
中文描述： TMS320R2811，TMS320R2812數(shù)字信號(hào)處理器
文件頁數(shù)： 3/147頁
文件大小： 2021K
代理商： TMR320R2811ZHHA
Contents
3
June 2004
SPRS257
Contents
Section
Page
1
2
Features
Introduction
2.1
2.2
2.3
11
12
12
13
14
14
15
16
17
27
28
31
31
31
32
32
32
32
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33
33
33
33
33
33
33
34
34
34
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35
35
35
37
38
39
39
40
43
44
45
46
47
47
48
48
50
50
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Description
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Device Summary
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Pin Assignments
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2.3.1
Terminal Assignments for the GHH and ZHH Packages
2.3.2
Pin Assignments for the PGF Package
2.3.3
Pin Assignments for the PBK Package
Signal Descriptions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Functional Overview
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3.1
Memory Map
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3.2
Brief Descriptions
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3.2.1
C28x CPU
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3.2.2
Memory Bus (Harvard Bus Architecture)
3.2.3
Peripheral Bus
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4
Real-Time JTAG and Analysis
3.2.5
External Interface (XINTF) (2812 Only)
3.2.6
M0, M1 SARAMs
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.7
L0, L1, L2, L3, H0 SARAMs
3.2.8
Boot ROM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.9
Security
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3.2.10
Peripheral Interrupt Expansion (PIE) Block
3.2.11
External Interrupts (XINT1, 2, 13, XNMI)
3.2.12
Oscillator and PLL
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.13
Watchdog
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3.2.14
Peripheral Clocking
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3.2.15
Low-Power Modes
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.16
Peripheral Frames 0, 1, 2 (PFn)
3.2.17
General-Purpose Input/Output (GPIO) Multiplexer
3.2.18
32-Bit CPU-Timers (0, 1, 2)
3.2.19
Control Peripherals
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.20
Serial Port Peripherals
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3
Register Map
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3.4
Device Emulation Registers
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3.5
External Interface, XINTF (2812 Only)
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3.5.1
Timing Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.5.2
XREVISION Register
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3.6
Interrupts
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3.6.1
External Interrupts
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.7
System Control
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3.7.1
OSC and PLL Block
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.7.2
Loss of Input Clock
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.7.3
PLL-Based Clock Module
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.7.4
External Reference Oscillator Clock Option
3.7.5
Watchdog Block
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.7.6
Low-Power Modes Block
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Peripherals
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.1
32-Bit CPU-Timers 0/1/2
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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2.4
3
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