參數(shù)資料
型號(hào)： SSD1905QT2
廠商： Electronic Theatre Controls, Inc.
英文描述： LCD Graphics Controller CMOS
中文描述： LCD圖形控制器的CMOS
文件頁(yè)數(shù)： 37/153頁(yè)
文件大小： 863K
代理商： SSD1905QT2
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SOLOMON
Rev 1.3
10/2002
SSD1905
28
LFRAME Pulse Stop Offset Register 0
7
6
LFRAME
Stop Offset
Bit 7
Bit 6
RW
RW
0
0
REG[34h]
0
LFRAME
Stop Offset
Bit 0
RW
0
Bit
5
4
3
2
1
LFRAME
Stop Offset
LFRAME
Stop Offset
Bit 5
RW
0
LFRAME
Stop Offset
Bit 4
RW
0
LFRAME
Stop Offset
Bit 3
RW
0
LFRAME
Stop Offset
Bit 2
RW
0
LFRAME
Stop Offset
Bit 1
RW
0
Type
Reset
state
LFRAME Pulse Stop Offset Register 1
7
6
0
0
REG[35h]
0
LFRAME
Stop Offset
Bit 8
RW
0
Bit
5
0
4
0
3
0
2
0
1
LFRAME
Stop Offset
Bit 9
RW
0
Type
Reset
state
REG[35h] bits 1-0
REG[34h] bits 7-0
NA
0
NA
0
NA
0
NA
0
NA
0
NA
0
LFRAME Pulse Stop Offset [9:0]
These bits specify the stop offset of the vertical sync signal within a line, in 1 pixel
resolution.
Note
For panel AC timing and timing parameter definitions, see Section 10.4 “Display Interface”.
HR-TFT Special Output Register
7
0
REG[38h]
0
CLS Double
Bit
6
0
5
4
3
2
1
PS
GPIO
Preset
Enable
RW
0
LSHIFT
Polarity
swap
RW
0
LSHIFT
Mask
GPIO0 /
GPIO1
Swap
RW
0
Alternate
Type
Reset
state
Bit 5
NA
0
NA
0
RW
0
RW
0
RW
0
GPIO Preset Enable
When this bit = 1, GPIO1 can be toggled once per line, GPIO0 and GPIO2 signals
should be programmed with the appropriate values with REG[3Ch], [3Eh] and [40h].
When this bit = 0, GPIO0, GPIO1 and GPIO2 signals are preset to defined values.
LSHIFT Polarity Swap
When this bit = 1, LSHIFT signal is falling trigger.
When this bit = 0, LSHIFT signal is rising trigger.
LSHIFT Mask
When this bit = 1, LSHIFT signal is enabled in non display period.
When this bit = 0, LSHIFT signal is masked in non display period.
GPIO0 / GPIO1 Swap
When this bit = 1, GPIO0 / GPIO1 signals are swapped.
When this bit = 0, GPIO0 / GPIO1 signals are not swapped.
PS Alternate
When this bit = 1, PS signal change alternatively.
When this bit = 0, PS signal remain the same.
CLS Double
When this bit = 1, number of CLS pulse remain the same.
When this bit = 0, number of CLS pulse will be doubled.
Note
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
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PDF描述
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