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參數(shù)資料
| 型號： | SN74ACT3641PQ |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Low-Voltage Quad 2-Input OR Gate with 5V-Tolerant Inputs, Pb-free; Package: SOEIAJ-14; No of Pins: 14; Container: Tape and Reel; Qty per Container: 2000 |
| 中文描述： | 1024】36時(shí)鐘先入先出存儲器 |
| 文件頁數(shù)： | 12/26頁 |
| 文件大?。?/td> | 379K |
| 代理商： | SN74ACT3641PQ |
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SN74ACT3641
1024
×
36
CLOCKED FIRST-IN, FIRST-OUT MEMORY
SCAS338C – JANUARY 1994 – REVISED OCTOBER 1997
12
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
(Y)
ììì
AE Offset
(X)
CLKA
RST
FS1, FS0
4
ENA
IR
A0–A35
tsu(FS)
th(FS)
tpd(C-IR)
ìììì
ìììì
First Word Stored in FIFO
th(D)
tsu(EN1)
th(EN1)
NOTE A: CSA = L, W/RA = H, MBA = L. It is not necessary to program offset register on consecutive clock cycles.
Figure 2. Programming the AF Flag and AE Flag Offset Values From Port A
(X) LSB
tsu(SD)
tsu(FS)
CLKA
RST
4
FS1/SEN
IR
FS0/SD
th(FS)
tpd(C-IR)
(Y) MSB
tsu(SD)
th(SEN)
tsu(SEN)
th(SP)
th(SEN)
tsu(FS)
NOTE A: It is not necessary to program offset register bits on consecutive clock cycles. FIFO write attempts are ignored until IR is set high.
Figure 3. Programming the AF Flag and AE Flag Offset Values Serially
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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