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參數(shù)資料
| 型號(hào)： | SH7706 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series |
| 中文描述： | 瑞薩32位RISC單片機(jī)超級(jí)系列RISC引擎Family/SH7700 |
| 文件頁數(shù)： | 30/709頁 |
| 文件大小： | 4500K |
| 代理商： | SH7706 |
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Rev. 4.00, 03/04, page xxx of xlvi
19.2
19.3
Input/Output Pin................................................................................................................ 497
Register Description.......................................................................................................... 497
19.3.1 A/D Data Registers A to D (ADDRA to ADDRD) ............................................. 498
19.3.2 A/D Control/Status Register (ADCSR) ............................................................... 499
19.3.3 A/D Control Register (ADCR) ............................................................................ 501
Bus Master Interface......................................................................................................... 501
Access Size of A/D Data Register .................................................................................... 503
19.5.1 Word Access........................................................................................................ 503
19.5.2 Longword Access ................................................................................................ 503
Operation .......................................................................................................................... 503
19.6.1 Single Mode (MULTI = 0) .................................................................................. 503
19.6.2 Multi Mode (MULTI = 1, SCN = 0).................................................................... 505
19.6.3 Scan Mode (MULTI = 1, SCN = 1)..................................................................... 506
19.6.4 Input Sampling and A/D Conversion Time ......................................................... 508
19.6.5 External Trigger Input Timing............................................................................. 509
Interrupt Requests............................................................................................................. 509
Definitions of A/D Conversion Accuracy......................................................................... 510
Usage Note........................................................................................................................ 511
19.9.1 Setting Analog Input Voltage .............................................................................. 511
19.9.2 Processing of Analog Input Pins.......................................................................... 511
19.9.3 Access Size and Read Data.................................................................................. 512
19.4
19.5
19.6
19.7
19.8
19.9
Section 20 D/A Converter (DAC).....................................................................513
20.1
Feature .............................................................................................................................. 513
20.2
Input/Output Pin................................................................................................................ 514
20.3
Register Description.......................................................................................................... 514
20.3.1 D/A Data Registers 0 and 1 (DADR0 and DADR1)............................................ 514
20.3.2 D/A Control Register (DACR) ............................................................................ 515
20.4
Operation .......................................................................................................................... 516
Section 21 User Debugging Interface (H-UDI).................................................517
21.1
Feature .............................................................................................................................. 518
21.2
Input/Output Pin................................................................................................................ 518
21.3
Register Description.......................................................................................................... 519
21.3.1 Bypass Register (SDBPR)................................................................................... 519
21.3.2 Instruction Register (SDIR)................................................................................. 519
21.3.3 Boundary Scan Register (SDBSR) ...................................................................... 520
21.4
H-UDI Operations............................................................................................................. 525
21.4.1 TAP Controller .................................................................................................... 525
21.4.2 Reset Configuration............................................................................................. 526
21.4.3 H-UDI Reset........................................................................................................ 527
21.4.4 H-UDI Interrupt................................................................................................... 527
21.4.5 Bypass.................................................................................................................. 527
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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