參數(shù)資料
型號： SH7706
廠商： Renesas Technology Corp.
英文描述： Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series
中文描述： 瑞薩32位RISC單片機超級系列RISC引擎Family/SH7700
文件頁數(shù)： 286/709頁
文件大?。?/td> 4500K
代理商： SH7706
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Rev. 4.00, 03/04, page 240 of 660
8.5.8
Bus Arbitration
When a bus release request (
BREQ
) is received from an external device, buses are released after
the bus cycle being executed is completed and a bus grant signal (
BACK
) is output
.
The bus is not
released during burst transfers for cache fills or a write back and TAS instruction execution
between the read cycle and write cycle. Bus arbitration is not executed in multiple bus cycles that
are generated when the data bus width is shorter than the access size; i.e. in the bus cycles when
longword access is executed for the 8-bit memory. At the negation of
BREQ
,
BACK
is negated
and bus use is restarted
.
See Appendix B, Pin Functions, for the pin state when the bus is released.
This LSI sometimes needs to retrieve a bus it has released. For example, when memory generates
a refresh request or an interrupt request internally, this LSI must perform the appropriate
processing. This LSI has a bus request signal (
IRQOUT
) for this purpose. When it must retrieve
the bus, it asserts the
IRQOUT
signal. Devices asserting an external bus release request receive the
assertion of the
IRQOUT
signal and negate the
BREQ
signal to release the bus. This LSI retrieves
the bus and carries out the processing.
IRQOUT
Pin Assertion Conditions:
When a memory refresh request has been generated but the refresh cycle has not yet begun
When an interrupt is generated with an interrupt request level higher than the setting of the
interrupt mask bits (I3 to I0) in the status register (SR). (This does not depend on the SR.BL
bit.)
8.5.9
Bus Pull-Up
With this LSI, address pin pull-up can be performed when the bus is released by setting the PULA
bit in BCR1 to 1. The address pins are pulled up for a 4-clock period after
BACK
is asserted.
Figure 8.40 shows the address pin pull-up timing. Similarly, data pin pull-up can be performed by
setting the PULD bit in BCR1 to 1. The data pins should be pulled up when the data bus is not in
use. The data pin pull-up timing for a read cycle is shown in figure 8.41, and the timing for a write
cycle in figure 8.42.
Hi-Z
Pull-up
CKIO
A25 to A0
Figure 8.40 Pins A25 to A0 Pull-Up Timing
相關PDF資料
PDF描述
SH7708 32-bit RISC (reduced instruction set computer) microcomputers
SH7708R 32-bit RISC (reduced instruction set computer) microcomputers
SH7708S 32-bit RISC (reduced instruction set computer) microcomputers
SH7729 Hitachi Microcomputer Development Environment System
SH7750R SuperH RISC engine
相關代理商/技術參數(shù)
參數(shù)描述
SH7708 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine
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SH7712 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer SuperHTM RISC engine Family / SH7700 Series
SH7727WCE-RP7 制造商:Renesas Electronics Corporation 功能描述:Dev Reference Platform SH7727 制造商:Renesas Electronics Corporation 功能描述:H-SUPPORT TOOL - Bulk
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