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參數(shù)資料
| 型號(hào)： | SH7706 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series |
| 中文描述： | 瑞薩32位RISC單片機(jī)超級(jí)系列RISC引擎Family/SH7700 |
| 文件頁數(shù)： | 25/709頁 |
| 文件大小： | 4500K |
| 代理商： | SH7706 |
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Rev. 4.00, 03/04, page xxv of xlvi
8.5.3
8.5.4
8.5.5
8.5.7
8.5.8
8.5.9
Basic Interface ..................................................................................................... 200
Synchronous DRAM Interface............................................................................. 205
PCMCIA Interface............................................................................................... 229
Waits between Access Cycles.............................................................................. 239
Bus Arbitration..................................................................................................... 240
Bus Pull-Up.......................................................................................................... 240
Section 9 Direct Memory Access Controller (DMAC) .................................... 243
9.1
Feature............................................................................................................................... 243
9.2
Input/Output Pin................................................................................................................ 245
9.3
Register Description.......................................................................................................... 245
9.3.1
DMA Source Address Registers 0 to 3 (SAR_0 to SAR_3)................................ 246
9.3.2
DMA Destination Address Registers 0 to 3 (DAR_0 to DAR_3)........................ 246
9.3.3
DMA Transfer Count Registers 0 to 3 (DMATCR_0 to DMATCR_3)............... 247
9.3.4
DMA Channel Control Registers 0 to 3 (CHCR_0 to CHCR_3)......................... 247
9.3.5
DMA Operation Register (DMAOR)................................................................... 253
9.4
Operation........................................................................................................................... 255
9.4.1
DMA Transfer Flow............................................................................................. 255
9.4.2
DMA Transfer Requests ...................................................................................... 257
9.4.3
Channel Priority................................................................................................... 259
9.4.4
DMA Transfer Types........................................................................................... 262
9.4.5
Number of Bus Cycle States and
DREQ
Pin Sampling Timing .......................... 274
9.4.6
Source Address Reload Function......................................................................... 278
9.4.7
DMA Transfer Ending Conditions....................................................................... 280
9.5
Compare Match Timer (CMT).......................................................................................... 282
9.5.1
Feature ................................................................................................................. 282
9.5.2
Register Description............................................................................................. 283
9.5.3
Operation ............................................................................................................. 285
9.6
Examples of Use ............................................................................................................... 287
9.6.1
Example of DMA Transfer between A/D Converter and External Memory
(Address Reload on) ............................................................................................ 287
9.6.2
Example of DMA Transfer between External Memory and SCIF Transmitter
(Indirect Address on) ........................................................................................... 288
9.7
Cautions ............................................................................................................................ 290
Section 10 Clock Pulse Generator (CPG)......................................................... 291
10.1
Feature............................................................................................................................... 291
10.2
Input/Output Pin................................................................................................................ 294
10.3
Clock Operating Modes.................................................................................................... 294
10.4
Register Description.......................................................................................................... 298
10.4.1 Frequency Control Register (FRQCR)................................................................. 298
10.5
Operation........................................................................................................................... 300
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SH7708 | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7708R | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7708S | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7729 | Hitachi Microcomputer Development Environment System |
| SH7750R | SuperH RISC engine |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SH7708 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
| SH7708R | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
| SH7708S | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
| SH7712 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer SuperHTM RISC engine Family / SH7700 Series |
| SH7727WCE-RP7 | 制造商:Renesas Electronics Corporation 功能描述:Dev Reference Platform SH7727 制造商:Renesas Electronics Corporation 功能描述:H-SUPPORT TOOL - Bulk |
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