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參數(shù)資料
| 型號： | SH7706 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series |
| 中文描述： | 瑞薩32位RISC單片機(jī)超級系列RISC引擎Family/SH7700 |
| 文件頁數(shù)： | 22/709頁 |
| 文件大小： | 4500K |
| 代理商： | SH7706 |
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Rev. 4.00, 03/04, page xxii of xlvi
3.3.4
MMU Functions................................................................................................................
3.4.1
MMU Hardware Management.............................................................................
3.4.2
MMU Software Management..............................................................................
3.4.3
MMU Instruction (LDTLB).................................................................................
3.4.4
Avoiding Synonym Problems..............................................................................
MMU Exceptions..............................................................................................................
3.5.1
TLB Miss Exception............................................................................................
3.5.2
TLB Protection Violation Exception ...................................................................
3.5.3
TLB Invalid Exception ........................................................................................
3.5.4
Initial Page Write Exception................................................................................
3.5.5
Processing Flow in Event of MMU Exception
(Same Processing Flow for CPU Address Error).................................................
Configuration of the Memory-Mapped TLB ....................................................................
3.6.1
Address Array......................................................................................................
3.6.2
Data Array............................................................................................................
3.6.3
Usage Examples...................................................................................................
Usage Note........................................................................................................................
3.7.1
Use of Instructions Manipulating MD and BL Bits in SR...................................
3.7.2
Use of TLB..........................................................................................................
Page Management Information............................................................................
64
65
65
65
66
67
69
69
70
71
72
3.4
3.5
74
76
76
76
78
78
78
79
3.6
3.7
Section 4 Exception Processing......................................................................... 81
4.1
Exception Processing Function.........................................................................................
4.1.1
Exception Processing Flow..................................................................................
4.1.2
Exception Processing Vector Addresses..............................................................
4.1.3
Acceptance of Exceptions....................................................................................
4.1.4
Exception Codes..................................................................................................
4.1.5
Exception Request and BL Bit.............................................................................
4.1.6
Returning from Exception Processing .................................................................
4.2
Register Description..........................................................................................................
4.2.1
Exception Event Register (EXPEVT)..................................................................
4.2.2
Interrupt Event Register (INTEVT).....................................................................
4.2.3
Interrupt Event Register 2 (INTEVT2)................................................................
4.2.4
TRAPA Exception Register (TRA) .....................................................................
4.3
Operation ..........................................................................................................................
4.3.1
Reset ....................................................................................................................
4.3.2
Interrupts..............................................................................................................
4.3.3
General Exceptions..............................................................................................
4.4
Individual Exception Operations.......................................................................................
4.4.1
Resets...................................................................................................................
4.4.2
General Exceptions..............................................................................................
4.4.3
Interrupts..............................................................................................................
4.5
Usage Note........................................................................................................................
81
81
82
83
85
86
86
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87
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89
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89
90
90
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96
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SH7708 | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7708R | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7708S | 32-bit RISC (reduced instruction set computer) microcomputers |
| SH7729 | Hitachi Microcomputer Development Environment System |
| SH7750R | SuperH RISC engine |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SH7708 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
| SH7708R | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
| SH7708S | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine |
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