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參數(shù)資料
| 型號(hào)： | SH7604 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Hardware Manual |
| 中文描述： | 硬件手冊(cè) |
| 文件頁(yè)數(shù)： | 12/633頁(yè) |
| 文件大小： | 2114K |
| 代理商： | SH7604 |
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vi
9.2
Register Descriptions......................................................................................................... 235
9.2.1
DMA Source Address Registers 0 and 1 (SAR0 and SAR1)............................... 235
9.2.2
DMA Destination Address Registers 0 and 1 (DAR0 and DAR1) ...................... 236
9.2.3
DMA Transfer Count Registers 0 and 1 (TCR0 and TCR1)................................ 236
9.2.4
DMA Channel Control Registers 0 and 1 (CHCR0 and CHCR1)........................ 237
9.2.5
DMA Vector Number Registers 0 and 1 (VCRDMA0, VCRDMA1).................. 241
9.2.6
DMA Request/Response Selection Control Registers 0 and 1
(DRCR0, DRCR1)................................................................................................ 242
9.2.7
DMA Operation Register (DMAOR)................................................................... 243
Operation............................................................................................................................ 245
9.3.1
DMA Transfer Flow ............................................................................................. 245
9.3.2
DMA Transfer Requests....................................................................................... 247
9.3.3
Channel Priorities.................................................................................................. 249
9.3.4
DMA Transfer Types............................................................................................ 251
9.3.5
Number of Bus Cycles.......................................................................................... 258
9.3.6
DMA Transfer Request Acknowledge Signal Output Timing ............................. 258
9.3.7
DREQ Pin Input Detection Timing ...................................................................... 268
9.3.8
DMA Transfer End............................................................................................... 283
Examples of Use................................................................................................................ 284
9.4.1
DMA Transfer Between On-Chip SCI and External Memory ............................. 284
Usage Notes........................................................................................................................ 285
9.3
9.4
9.5
Section 10 Division Unit
.................................................................................................... 287
10.1
Overview............................................................................................................................ 287
10.1.1 Features................................................................................................................. 287
10.1.2 Block Diagram...................................................................................................... 288
10.1.3 Register Configuration.......................................................................................... 288
10.2
Description of Registers..................................................................................................... 289
10.2.1 Divisor Register (DVSR)...................................................................................... 289
10.2.2 Dividend Register L for 32-Bit Division (DVDNT) ............................................ 289
10.2.3 Division Control Register (DVCR)...................................................................... 290
10.2.4 Vector Number Setting Register DIV (VCRDIV)................................................ 291
10.2.5 Dividend Register H (DVDNTH)......................................................................... 291
10.2.6 Dividend Register L (DVDNTL).......................................................................... 292
10.3
Operation............................................................................................................................ 292
10.3.1 64-Bit
÷
32-Bit Operations ................................................................................... 292
10.3.2 32-Bit
÷
32-Bit Operations ................................................................................... 292
10.3.3 Handling of Overflows ......................................................................................... 293
10.4
Usage Notes ....................................................................................................................... 293
10.4.1 Access................................................................................................................... 293
10.4.2 Overflow Flag....................................................................................................... 294
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