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參數(shù)資料
| 型號(hào)： | SH7145F-ZTAT |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi SuperH RISC engine |
| 中文描述： | 日立的SuperH RISC引擎 |
| 文件頁(yè)數(shù)： | 204/773頁(yè) |
| 文件大?。?/td> | 4187K |
| 代理商： | SH7145F-ZTAT |
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Rev. 2.0, 09/02, page 164 of 732
= 1, DME = 1, TE = 0, NMIF = 0, AE = 0), a transfer is performed upon the input of a transfer
request signal.
The transfer request source need not be the data transfer source or transfer destination. However,
when the transfer request is set by RXI (transfer request because SCI’s receive data is full), the
transfer source must be the SCI’s receive data register (RDR). When the transfer request is set by
TXI (transfer request because SCI’s transmit data is empty), the transfer destination must be the
SCI’s transmit data register (TDR). Also, if the transfer request is set to the A/D converter, the
data transfer destination must be the A/D converter register.
Table 10.3 Selecting On-Chip Peripheral Module Request Modes with the RS Bits
RS3 RS2 RS1 RS0
DMAC Transfer
Request Source
DMA Transfer
Request SignalSource
Desti-
nation
Bus Mode
0
1
1
0
MTU
TGIA_0
Any
*
Any
*
Burst/cycle steal
0
1
1
1
MTU
TGIA_1
Any
*
Any
*
Burst/cycle steal
1
0
0
0
MTU
TGIA_2
Any
*
Any
*
Burst/cycle steal
1
0
0
1
MTU
TGIA_3
Any
*
Any
*
Burst/cycle steal
1
0
1
0
MTU
TGIA_4
Any
*
Any
*
Burst/cycle steal
1
0
1
1
A/D1
ADI1
ADDR1
Any
*
Burst/cycle steal
1
1
0
0
SCI0 transmit block
TXI_0
Any
*
TDR0
Burst/cycle steal
1
1
0
1
SCI0 receiver block
RXI_0
RDR0
Any
*
Burst/cycle steal
1
1
1
0
SCI1 transmit block
TXI_1
Any
*
TDR1
Burst/cycle steal
1
Notes:
*
External memory, memory-mapped external device, on-chip memory, on-chip peripheral
module (excluding DMAC, DTC, BSC, UBC).
MTU: Multifunction timer pulse unit.
SCI0, SCI1: Serial communications interface channels 0 and 1.
ADDR1: A/D converter’s A/D register.
TDR_0, TDR_1: SCI_0 and SCI_1 transmit data registers.
RDR_0, RDR_1: SCI_0 and SCI_1 receive data registers.
1
1
1
SCI1 receiver block
RXI_1
RDR1
Any
*
Burst/cycle steal
In order to output a transfer request from an on-chip peripheral module, set the relevant interrupt
enable bit for each module, and output an interrupt signal.
When an on-chip peripheral module’s interrupt request signal is used as a DMA transfer request
signal, interrupts for the CPU are not generated.
When a DMA transfer is conducted corresponding with one of the transfer request signals in table
10.3, it is automatically discontinued. In cycle steal mode this occurs in the first transfer, and in
burst mode in the last transfer.
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參數(shù)描述 |
|---|---|
| SH716A | 制造商:Thomas & Betts 功能描述:HOOD,SIDE ENTRY |
| SH716AMV | 制造商:Thomas & Betts 功能描述:A16 SINGLE LOCK SYS 1XPG21-3/4 |
| SH716-H | 制造商:Thomas & Betts 功能描述:HOOD,SIDE ENTRY |
| SH716HMV | 制造商:Thomas & Betts 功能描述:B16 SINGLE LOCK SYS 1XPG29-1 |
| SH-72 | 制造商:PANASONIC ELECTRIC WORKS - ACSD 功能描述:SENSOR 7.5MM GLASS BOAD 制造商:Panasonic Electric Works 功能描述:Photoelectric Sensor |
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