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參數(shù)資料
| 型號： | SH7144 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi SuperH RISC engine |
| 中文描述： | 日立的SuperH RISC引擎 |
| 文件頁數(shù)： | 59/773頁 |
| 文件大小： | 4187K |
| 代理商： | SH7144 |
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Rev. 2.0, 09/02, page 19 of 732
Table 2.2 Sign Extension of Word Data
CPU of This LSI
Description
Example of Conventional CPU
MOV.W @(disp,PC),R1
ADD R1,R0
.........
.DATA.W H'1234
Note:
@(disp, PC) accesses the immediate data.
Data is sign-extended to 32
bits, and R1 becomes
H'00001234. It is next
operated upon by an ADD
instruction.
ADD.W #H'1234,R0
Load-Store Architecture
: Basic operations are executed between registers. For operations that
involve memory access, data is loaded to the registers and executed (load-store architecture).
Instructions such as AND that manipulate bits, however, are executed directly in memory.
Delayed Branch Instructions:
Unconditional branch instructions are delayed branch instructions.
With a delayed branch instruction, the branch is taken after execution of the instruction following
the delayed branch instruction. This reduces the disturbance of the pipeline control in case of
branch instructions. There are two types of conditional branch instructions: delayed branch
instructions and ordinary branch instructions.
Table 2.3 Delayed Branch Instructions
CPU of This LSI
Description
Example of Conventional CPU
BRA TRGET
ADD R1,R0
Executes the ADD before
branching to TRGET.
ADD.W R1,R0
BRA TRGET
Multiply/Multiply-and-Accumulate Operations:
16-bit
×
16-bit
→
32-bit multiply operations
are executed in one to two states. 16-bit
×
16-bit + 64-bit
→
64-bit multiply-and-accumulate
operations are executed in two to three states. 32-bit
×
32-bit
→
64-bit multiply and 32-bit
×
32-bit
+ 64-bit
→
64-bit multiply-and-accumulate operations are executed in two to four states.
T Bit
: The T bit in the status register changes according to the result of the comparison. Whether a
conditional branch is taken or not taken depends upon the T bit condition (true/false). The number
of instructions that change the T bit is kept to a minimum to improve the processing speed.
相關PDF資料 |
PDF描述 |
|---|---|
| SH7144F-ZTAT | Hitachi SuperH RISC engine |
| SH7145 | Hitachi SuperH RISC engine |
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| SH7604 | Hardware Manual |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SH7144F-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi SuperH RISC engine |
| SH7145 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi SuperH RISC engine |
| SH7145F-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi SuperH RISC engine |
| SH716A | 制造商:Thomas & Betts 功能描述:HOOD,SIDE ENTRY |
| SH716AMV | 制造商:Thomas & Betts 功能描述:A16 SINGLE LOCK SYS 1XPG21-3/4 |
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