- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄374786 > SH7045 (Renesas Technology Corp.) Renesas 32-Bit Single-Chip RISC Microprocessor SuperH RISC engine Family/SH7040 Series(CPU Core SH-2) PDF資料下載
參數(shù)資料
| 型號： | SH7045 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Renesas 32-Bit Single-Chip RISC Microprocessor SuperH RISC engine Family/SH7040 Series(CPU Core SH-2) |
| 中文描述： | 瑞薩32位單芯片RISC微處理器的SuperH RISC引擎Family/SH7040系列（CPU核心的SH - 2） |
| 文件頁數(shù)： | 727/923頁 |
| 文件大?。?/td> | 4295K |
| 代理商： | SH7045 |
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689
22.3
Pin Configuration
The flash memory is controlled by the pins shown in table 22.2.
Table 22.2
Pin Configuration
Pin Name
Power-on reset
Flash write protect
Abbreviation
RES
FWP
I/O
Input
Input
Function
Power-on reset
Flash program/erase protection by hardware
Set operation mode of LSI
Set operation mode of LSI
Set operation mode of LSI
Set operation mode of LSI
Serial send data output
Serial receive data input
Mode 3
Mode 2
Mode 1
Mode 0
Transmit data
Receive data
MD3
MD2
MD1
MD0
TxD1
RxD1
Input
Input
Input
Input
Output
Input
22.4
Register Configuration
Registers that control the flash memory when the on-chip flash memory is valid are shown in table
22.3.
Table 22.3
Register Configuration
Name
Flash memory control register 1
Flash memory control register 2
Erase block register 1
Erase block register 2
RAM emulation register
Notes: 1. FLMCR1, FLMCR2, EBR1, and EBR2 are 8-bit registers, and RAMER is a 16-bit
register.
2. Only byte accesses are valid for FLMCR1, FLMCR2, EBR1, and EBR2, the access
requiring 3 cycles. Three cycles are required for a byte or word access to RAMER, and
6 cycles for a longword access.
3. When a longword write is performed on RAMER, 0 must always be written to the lower
word (address H'FFFF8630). Operation is not guaranteed if any other value is written.
*
1 In modes in which the on-chip flash memory is disabled, a read will return H'00, and
writes are invalid. Writes are also disabled when the FWE bit is set to 1 in FLMCR1.
*
2 When a low level is input to the FWP pin, the initial value is H'80.
*
3 When a high level is input to the FWP pin, or if a low level is input and the SWE bit in
FLMCR1 is not set, these registers are initialized to H'00.
Abbre-
viation
FLMCR1 R/W
*
1
FLMCR2 R/W
*
1
EBR1
EBR2
RAMER
R/W
Initial Value
H'00
*
2
H'00
*
3
H'00
*
3
H'00
*
3
H'0000
Address
H'FFFF8580 8
H'FFFF8581 8
H'FFFF8582 8
H'FFFF8583 8
H'FFFF8628 8, 16, 32
Access Size
R/W
*
1
R/W
*
1
R/W
相關PDF資料 |
PDF描述 |
|---|---|
| SH7055 | Renesas 32-Bit Single-Chip RISC Microprocessor SuperH RISC engine Family/SH7040 Series(CPU Core SH-2) |
| SH7043 | SH7043 Series FP-144 User System Interface Cable |
| SH7144 | Hitachi SuperH RISC engine |
| SH7144F-ZTAT | Hitachi SuperH RISC engine |
| SH7145 | Hitachi SuperH RISC engine |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SH7047F | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer SuperH RISC engine Family/SH7047 Series |
| SH-7050 TA | 制造商:Compit 功能描述: |
| SH-7050 TB | 制造商:Compit 功能描述: |
| SH-7050MA | 制造商:COOPER 制造商全稱:Cooper Bussmann, Inc. 功能描述:ROTARY CODED SWITCHES SMD |
| SH-7050MB | 制造商:Compit 功能描述: |
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