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參數(shù)資料
| 型號： | SDA5254 |
| 廠商： | SIEMENS A G |
| 元件分類： | 圖文 |
| 英文描述： | 8-BIT SINGLE CHIP MICROCONTROLLERS |
| 中文描述： | TELETEXT AND VPS/PDC DECODER, PDIP52 |
| 文件頁數(shù)： | 52/143頁 |
| 文件大?。?/td> | 1050K |
| 代理商： | SDA5254 |
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SDA 525x
Semiconductor Group
52
1998-04-08
MOVC-Handling
MOVC-instructions may operate in two different modes, that are selected by bit MM in
MEX2. On MM = 0 MOVC will access the current bank. On MM = 1 the bits MB16 – 18
will appear at A16 – A18 during MOVC.
Figure 18
PC and DPTR on Different Banks
CALLs and Interrupts
For flexible use of CALL and interrupts the control logic holds an own 32 levels-six-bit-
stack. Whenever a LCALL or ACALL occurs, CB16 – 18 and NB16 – 18 (MEX1) is
copied to this stack and the memory extension stackpointer is incremented. Then
NB16 – 18 is copied to CB16 – 18. Leaving subroutines through RET or RETI
decrements the stack pointer and reads the old NB and CB contents from the stack. All
six bits are required for saving to prevent conflicts on interrupt events. One additional
feature simplifies the handling of interrupts: on occurrence the bits IB16 – 18 within
MEX2 are copied to CB16 – 18 and NB16 – 18 after pushing their old contents on the
stack. This way programmers can place their ISR (Interrupt Service Routine) on specific
banks. After reset MM, MB16 – 18 and IB16 – 18 are set to zero.
Table 9
Port 4 Configuration
CB
0
0
1
1
P4 Latch
0
1
0
1
P4 Out
0
0
0
1
Comment
x
Address
P4
Addr / P4
UEC04717
MM=1, MB
16-17
=3, CB
16-17
=2
Bank 2
Bank 3
DPTR
PC
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