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參數(shù)資料
| 型號： | MX53L06402L-50 |
| 廠商： | MACRONIX INTERNATIONAL CO LTD |
| 元件分類： | PROM |
| 英文描述： | FLASH 2.7V PROM CARD, XMA7 |
| 封裝： | CRAD-7 |
| 文件頁數(shù)： | 33/55頁 |
| 文件大?。?/td> | 262K |
| 代理商： | MX53L06402L-50 |
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39
P/N: PM1043
REV. 1.0, NOV. 25, 2003
MX53L06402
7.8 SPI Bus Timing Diagrams
All timing diagrams use the following schematics and abbreviations:
All timing values are defined in Table 27. The host must keep the clock running for at least N
CR clock cycles after
receiving the card response. This restriction applies to both command and data response tokens.
H
Signal is high (logical '1')
L
Signal is low (logical '0')
X
Don't care
Z
High impedance state (-> = 1)
*
Repeater
Busy
Busy Token
Command
Command token
Response
Response token
Data block
Data token
7.8.1 Command / Response
Host Command to Card Response - Card is ready
The following timing diagram describes the basic command response (no data) SPI transaction.
Card Response to Host Command
HH
H
X
H
H H
HH H HH
HH
H
L
LH H
HX X X
H
H H HH
Z
1 or 2 Bytes Response
6 Bytes Command
H
Z
H HH
LL
L
********************
*********
<-NCS->
<-NCR->
CS
DataIN
DataOut
<-NEC->
LL
H
H H
HH H H
H H HH
HH
H
L
LH H
HX
X X
H
H H HH
Z
1 or 2 Bytes Response
6 Bytes Command
**********
H
LL
L
********************
*********
<-NRC->
CS
DataIN
DataOut
H
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