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參數(shù)資料
| 型號(hào)： | MT48V4M32TG-8XT |
| 元件分類： | DRAM |
| 英文描述： | 4M X 32 SYNCHRONOUS DRAM, 7 ns, PDSO54 |
| 封裝： | 0.400 INCH, PLASTIC, TSOP2-54 |
| 文件頁(yè)數(shù)： | 51/69頁(yè) |
| 文件大小： | 6213K |
| 代理商： | MT48V4M32TG-8XT |
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128Mb: x16, x32
MOBILE SDRAM
09005aef8071a76b
Micron Technology, Inc., reserves the right to change products or specifications without notice.
128Mbx16x32Mobile_2.fm - Rev. G (DRAFT) 7/04 EN
55
2001 Micron Technology, Inc. All rights reserved.
Figure 42: Single Read – Without Auto Precharge
NOTE:
1. For this example, the burst length = 4, the CAS latency = 2, and the READ burst is followed by a “manual” PRECHARGE.
2. x16:A9 and A11 = “Don’t Care”
x32:A8, A9,and A11 = “Don’t Care”
3. PRECHARGE command not allowed or tRAS would be violated.
ALL BANKS
tCH
tCL
tAC
tLZ
tRP
tRAS
tRCD
CAS Latency
tRC
tOH
DOUT m
tCMH
tCMS
tAH
tAS
tAH
tAS
tAH
tAS
ROW
BANK
BANK(S)
BANK
ROW
BANK
tHZ
tCMH
tCMS
NOP
PRECHARGE
ACTIVE
NOP
READ
ACTIVE
NOP
DISABLE AUTO PRECHARGE
SINGLE BANKS
DON’T CARE
UNDEFINED
COLUMN m2
tCKH
tCKS
T0
T1
T2
T3
T4
T5
T6
T7
T8
DQMU, DQML
CKE
CLK
A0-A9, A11
DQ
BA0, BA1
A10
COMMAND
3
tCK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT48LC8M8A2TG-8EL:GIT | 8M X 8 SYNCHRONOUS DRAM, 6 ns, PDSO54 |
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參數(shù)描述 |
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