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參數(shù)資料
| 型號(hào)： | MT47H64M16HR-3IT |
| 元件分類： | DRAM |
| 英文描述： | 64M X 16 DDR DRAM, 0.4 ns, PBGA84 |
| 封裝： | 8 X 12.50 MM, ROHS COMPLIANT, FBGA-84 |
| 文件頁數(shù)： | 92/129頁 |
| 文件大小： | 9252K |
| 代理商： | MT47H64M16HR-3IT |
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Commands
Truth Tables
The following tables provide a quick reference of available DDR2 SDRAM commands,
including CKE power-down modes and bank-to-bank commands.
Table 36: Truth Table – DDR2 Commands
Notes: 1–3 apply to the entire table
Function
CKE
CS#
RAS# CAS# WE#
BA2–
BA0 An–A11 A10
A9–A0 Notes
Previous
Cycle
Current
Cycle
LOAD MODE
H
L
BA
OP code
REFRESH
H
L
H
X
SELF REFRESH entry
H
L
H
X
SELF REFRESH exit
L
H
X
L
H
Single bank
PRECHARGE
H
L
H
L
BA
X
L
X
All banks PRECHARGE
H
L
H
L
X
H
X
Bank ACTIVATE
H
L
H
BA
Row address
WRITE
H
L
H
L
BA
Column
address
L
Column
address
WRITE with auto
precharge
H
L
H
L
BA
Column
address
H
Column
address
READ
H
L
H
L
H
BA
Column
address
L
Column
address
READ with auto
precharge
H
L
H
L
H
BA
Column
address
H
Column
address
NO OPERATION
H
X
L
H
X
Device DESELECT
H
X
H
X
Power-down entry
H
L
H
X
L
H
Power-down exit
L
H
X
L
H
Notes: 1. All DDR2 SDRAM commands are defined by states of CS#, RAS#, CAS#, WE#, and CKE at
the rising edge of the clock.
2. The state of ODT does not affect the states described in this table. The ODT function is
not available during self refresh. See ODT Timing (page 123) for details.
3.
“X” means “H or L” (but a defined logic level) for valid IDD measurements.
4. BA2 is only applicable for densities
≥1Gb.
5. An n is the most significant address bit for a given density and configuration. Some larg-
er address bits may be “Don’t Care” during column addressing, depending on density
and configuration.
1Gb: x4, x8, x16 1.55V DDR2 SDRAM
Commands
PDF: 09005aef82b91d01
1GbDDR2_1_55V.PDF Rev. A 5/09 EN
65
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT48H8M16LFB4-8IT:JTR | 8M X 16 SYNCHRONOUS DRAM, 6 ns, PBGA54 |
| MT48LC4M32TG-10 | 4M X 32 SYNCHRONOUS DRAM, 7 ns, PDSO54 |
| MT48V8M16LFB4-8XT | 8M X 16 SYNCHRONOUS DRAM, 7 ns, PBGA54 |
| MT48LC4M32LFB5-10ES:G | 4M X 32 SYNCHRONOUS DRAM, 7 ns, PBGA90 |
| MT48V4M32TG-8XT | 4M X 32 SYNCHRONOUS DRAM, 7 ns, PDSO54 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT47H64M16HR-3L | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DDR2 SDRAM |
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