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參數(shù)資料
| 型號： | MPC5553EVBE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 20/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVAL FOR MPC5553 |
| 產(chǎn)品培訓模塊： | MPC55xx PitchPak Family |
| 標準包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | MPC5553 |
| 所含物品： | 評估板和演示軟件 |
| 配用： | MFR4310FRDC-ND - FRDC FLEXRAY DAUGHTER CARD |
| 相關(guān)產(chǎn)品： | MPC5553MZQ132-ND - IC MCU MPC5553 REV A 324-PBGA MPC5553MZP132-ND - IC MCU MPC5553 REV A 416-PBGA |
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Electrical Characteristics
MPC5553 Microcontroller Data Sheet, Rev. 4
Freescale Semiconductor
27
Figure 4. Pad Output Delay
3.13
AC Timing
3.13.1
Reset and Configuration Pin Timing
3 The output delay, and the rise and fall, are calculated to 20% or 80% of the respective signal.
4 The output delay is shown in Figure 4. To calculate the output delay with respect to the system clock, add a maximum of one
system clock to the output delay.
5 This parameter is guaranteed by characterization rather than 100% tested.
Table 19. Reset and Configuration Pin Timing 1
1 Reset timing specified at: V
DDEH = 3.0–5.25 V and TA = TL to TH.
Spec
Characteristic
Symbol
Min.
Max.
Unit
1
RESET pulse width
tRPW
10
—
tCYC
2
RESET glitch detect pulse width
tGPW
2—
tCYC
3
PLLCFG, BOOTCFG, WKPCFG, RSTCFG setup time to RSTOUT valid
tRCSU
10
—
tCYC
4
PLLCFG, BOOTCFG, WKPCFG, RSTCFG hold time from RSTOUT valid
tRCH
0—
tCYC
VDD 2
VOH
VOL
Rising-edge
out delay
Falling-edge
Pad
internal data
Pad
output
out delay
input signal
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| STD12W-X | WIRE & CABLE MARKERS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MPC5553EVBISYS | 功能描述:開發(fā)軟件 ISYSTEMS CONTENT Qorivva RoHS:否 制造商:Atollic Inc. 產(chǎn)品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| MPC5553MVF112 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontroller |
| MPC5553MVF112R2 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontroller |
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