參數(shù)資料
型號： LPC47B37X
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications
中文描述： 100引腳增強的超級I / O控制器，帶有SMBus為商業(yè)應用的LPC總線
文件頁數(shù)： 177/254頁
文件大小： 659K
代理商： LPC47B37X
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177
NAME
REG OFFSET
(hex)
22
DESCRIPTION
Device Disable
Register
Default = 0x00
VTR POR
Read/Write when
GP43 register
bits[3:2] = 01
AND
GP43 pin = 0
OR
GP43 register
bits[3:2]
≠
01
READ-ONLY
When GP43
register bits[3:2]
=01 AND GP43
pin = 1
If “0” (enabled), bits[7:3] have no effect on the devices;
devices are controlled by their respective activate bits.
If “1” (disabled), bits[7:3] override the activate bits in the
configuration registers for each logical block.
Bit[0] Floppy Write Protect.
0= no effect: floppy write protection is controlled by the
write protect pin or the Forced Write Protect bit (bit 0 of
register 0xF1 in Logical Device 0);
1= Write Protected.
If set to 1, this bit overrides the write protect pin on the
part and the forced write protect bit.
nWRTPRT (to the FDC Core) = WP (FDC SRA
Register, Bit 1) = (Floppy Write Protect) OR
nWRTPRT(from the FDD Interface) OR (nDS0 AND
Force Write Protect ) OR (nDS1 AND Force Write
Protect ).
Note: The Force Write Protect bit is in the FDD Option
Configuration register.
Bits[2:1] Reserved. Return 0 on read.
Bit[3]: Floppy Enable.
0=No effect: FDC controlled by its activate bit;
1=Floppy Disabled
Bit[4] Reserved
Bit[5] Serial Port 2 Enable
0=No effect: UART2 controlled by its activate bit;
1=UART2 Disabled
Bit[6] Serial Port 1 Enable.
0=No effect: UART1 controlled by its activate bit;
1=UART1 Disabled
Bit[7] Parallel Port Enable.
0=No effect: PP controlled by its activate bit;
1=PP Disabled
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