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參數(shù)資料
| 型號： | LPC47B27X |
| 廠商： | SMSC Corporation |
| 英文描述： | Round, Jacket Mass-Terminated Cable, 3659/26 28 AWG, .050 (1.27) |
| 中文描述： | 100引腳增強型超的I / O LPC接口控制器 |
| 文件頁數(shù)： | 51/196頁 |
| 文件大小： | 1200K |
| 代理商： | LPC47B27X |
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SMSC LPC47B27x
- 51 -
Rev. 08-10-04
DATASHEET
Table 25 - Interrupt Identification
IC
INTERRUPT DUE TO
11
00
01
Abnormal termination of Seek
or Recalibrate command
SE
0
1
1
Polling
Normal termination of Seek or
Recalibrate command
The Seek, Relative Seek, and Recalibrate commands have no result phase. The Sense Interrupt Status command must
be issued immediately after these commands to terminate them and to provide verification of the head position (PCN).
The H (Head Address) bit in ST0 will always return a "0". If a Sense Interrupt Status is not issued, the drive will continue
to be BUSY and may affect the operation of the next command.
Sense Drive Status
Sense Drive Status obtains drive status information. It has not execution phase and goes directly to the result phase
from the command phase. Status Register 3 contains the drive status information.
Specify
The Specify command sets the initial values for each of the three internal times. The HUT (Head Unload Time) defines
the time from the end of the execution phase of one of the read/write commands to the head unload state. The SRT
(Step Rate Time) defines the time interval between adjacent step pulses. Note that the spacing between the first and
second step pulses may be shorter than the remaining step pulses. The HLT (Head Load Time) defines the time
between when the Head Load signal goes high and the read/write operation starts. The values change with the data
rate speed selection and are documented in Table 26. The values are the same for MFM and FM.
DMA operation is selected by the ND bit. When ND is "0", the DMA mode is selected. In DMA mode, data transfers are
signaled by the DMA request cycles.
Configure
The Configure command is issued to select the special features of the FDC. A Configure command need not be issued
if the default values of the FDC meet the system requirements.
Table 26 - Drive Control Delays (ms)
HUT
2M
1M
500K
300K
250K
0
1
..
E
F
60
120
240
400
480
2M
1M
500K
00
01
02
..
7F
7F
63.5
127
Configure Default Values:
EIS - No Implied Seeks
EFIFO - FIFO Disabled
POLL - Polling Enabled
FIFOTHR - FIFO Threshold Set to 1 Byte
PRETRK - Pre-Compensation Set to Track 0
EIS - Enable Implied Seek. When set to "1", the FDC will perform a Seek operation before executing a read or write
command. Defaults to no implied seek.
SRT
2M
4
3.75
..
0.5
0.25
1M
8
7.5
..
1
0.5
500K
16
15
..
2
1
300K
26.7
25
..
3.33
1.67
250K
32
30
..
4
2
64
4
..
56
128
8
..
112
256
16
..
224
426
26.7
..
373
512
32
..
448
HLT
300K
426
3.3
6.7
..
420
423
250K
512
4
8
.
504
508
64
0.5
1
..
63
128
1
2
..
126
256
2
4
..
252
254
相關PDF資料 |
PDF描述 |
|---|---|
| LPC47B34X | 128 Pin Enhanced Super I/O with LPC Interface for Consumer Applications |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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