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參數資料
| 型號： | LPC47B27X |
| 廠商： | SMSC Corporation |
| 英文描述： | Round, Jacket Mass-Terminated Cable, 3659/26 28 AWG, .050 (1.27) |
| 中文描述： | 100引腳增強型超的I / O LPC接口控制器 |
| 文件頁數： | 19/196頁 |
| 文件大?。?/td> | 1200K |
| 代理商： | LPC47B27X |
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SMSC LPC47B27x
- 19 -
Rev. 08-10-04
DATASHEET
FUNCTIONAL DESCRIPTION
SUPER I/O REGISTERS
The address map, shown below in Table 1, shows the addresses of the different blocks of the Super I/O immediately
after power up. The base addresses of the FDC, serial and parallel ports, PME register block, Game port and
configuration register block can be moved via the configuration registers. Some addresses are used to access more
than one register.
HOST PROCESSOR INTERFACE (LPC)
The host processor communicates with the LPC47B27x through a series of read/write registers via the LPC interface.
The port addresses for these registers are shown in Table 1. Register access is accomplished through I/O cycles or
DMA transfers. All registers are 8 bits wide.
Table 1 - Super I/O Block Addresses
ADDRESS
BLOCK NAME
Base+(0-5) and +(7)
Floppy Disk
Base+(0-7)
Serial Port Com 1
Base1+(0-7)
Base2+(0-7)
Base+(0-3)
Base+(0-7)
Base+(0-3), +(400-402)
Base+(0-7), +(400-402)
ECP+EPP+SPP
60, 64
KYBD
Base + 0
Game Port
Base + (0-5F)
Runtime Registers
Base + (0-1)
MPU-401
Base + (0-1)
Configuration
Note 1: Refer to the configuration register descriptions for setting the base address.
LPC INTERFACE
The following sub-sections specify the implementation of the LPC bus.
LPC Interface Signal Definition
The signals required for the LPC bus interface are described in the table below. LPC bus signals use PCI 33MHz
electrical signal characteristics.
SIGNAL NAME
TYPE
LAD[3:0]
I/O
LPC address/data bus. Multiplexed command, address and data bus.
nLFRAME
Input
Frame signal. Indicates start of new cycle and termination of broken
cycle
nPCI_RESET
Input
PCI Reset. Used as LPC Interface Reset.
nLDRQ
Output
Encoded DMA/Bus Master request for the LPC interface.
nIO_PME
OD
Power Mgt Event signal. Allows the LPC47B27x to request wakeup.
nLPCPD
Input
Powerdown Signal. Indicates that the LPC47B27x should prepare for
power to be shut on the LPC interface.
SER_IRQ
I/O
Serial IRQ.
PCI_CLK
Input
PCI Clock.
Note: The nCLKRUN signal is not implemented in this part.
LOGICAL
DEVICE
0
4
5
NOTES
IR Support
Consumer IR
Serial Port Com 2
Parallel Port
SPP
EPP
ECP
3
7
9
A
B
DESCRIPTION
相關PDF資料 |
PDF描述 |
|---|---|
| LPC47B34X | 128 Pin Enhanced Super I/O with LPC Interface for Consumer Applications |
| LPC47B37X | 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications |
| LPC47M14X-NC | 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB |
| LPC47M14Y-NC | 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB |
| LPC47M14Z-NC | 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB |
相關代理商/技術參數 |
參數描述 |
|---|---|
| LPC47B34X | 制造商:SMSC 制造商全稱:SMSC 功能描述:128 Pin Enhanced Super I/O with LPC Interface for Consumer Applications |
| LPC47B351-NC | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| LPC47B357-NC | 制造商:SMSC 功能描述:ELECTRONIC COMPONENT |
| LPC47B373QFP | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:SMSC 功能描述: |
| LPC47B373QFP WAF | 制造商:SMSC 功能描述: |
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