參數(shù)資料
型號(hào): LPC47B27X
廠商: SMSC Corporation
英文描述: Round, Jacket Mass-Terminated Cable, 3659/26 28 AWG, .050 (1.27)
中文描述: 100引腳增強(qiáng)型超的I / O LPC接口控制器
文件頁(yè)數(shù): 164/196頁(yè)
文件大?。?/td> 1200K
代理商: LPC47B27X
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SMSC LPC47B27x
- 164 -
Rev. 08-10-04
DATASHEET
Table 69 - Parallel Port, Logical Device 3 [Logical Device Number = 0x03]
NAME
REG INDEX
PP Mode Register
Default = 0x3C
on VCC POR,
VTR POR and
HARD RESET
= 010
= 011
= 111
Bit[6:3] ECP FIFO Threshold
0111b (default)
Bit[7] PP Interupt Type
Not valid when the parallel port is in the Printer
Mode (100) or the Standard & Bi-directional Mode
(000).
= 1
= 0
DEFINITION
STATE
C
0xF0 R/W
Bits[2:0] Parallel Port Mode
= 100
Printer Mode (default)
= 000
Standard and Bi-directional (SPP) Mode
= 001
EPP-1.9 and SPP Mode
= 101
EPP-1.7 and SPP Mode
ECP Mode
ECP and EPP-1.9 Mode
ECP and EPP-1.7 Mode
Pulsed Low, released to high-Z.
IRQ follows nACK when parallel port in EPP
Mode or [Printer,SPP, EPP] under ECP.
IRQ level type when the parallel port is in ECP, TEST,
or Centronics FIFO Mode.
Bits[1:0] PPFDC - muxed PP/FDC control
= 00 Normal Parallel Port Mode
= 01 PPFD1:
Drive 0 is on the FDC pins
Drive 1 is on the Parallel port pins
= 10 PPFD2:
Drive 0 is on the Parallel port pins
Drive 1 is on the Parallel port pins
Bits[7:2] Reserved. Set to zero.
PP Mode Register 2
Default = 0x00
on VCC POR,
VTR POR and
HARD RESET
0xF1 R/W
Table 70 - Serial Port 1, Logical Device 4 [Logical Device Number = 0x04]
REG INDEX
0xF0 R/W
Bit[0] MIDI Mode
= 0
MIDI support disabled (default)
= 1
MIDI support enabled
Bit[1] High Speed
= 0
High Speed Disabled(default)
= 1
High Speed Enabled
Bit[6:2] Reserved, set to zero
Bit[7]: Share IRQ
=0 UARTS use different IRQs
=1 UARTS share a common IRQ
See Note 1 below.
NAME
DEFINITION
STATE
C
Serial Port 1
Mode Register
Default = 0x00
on VCC POR,
VTR POR and
HARD RESET
Note 1: To properly share and IRQ,
1. Configure UART1 (or UART2) to use the desired IRQ.
2. Configure UART2 (or UART1) to use No IRQ selected.
3. Set the share IRQ bit.
Note: If both UARTs are configured to use different IRQs and the share IRQ bit is set, then both of the
UART IRQs will assert when either UART generates an interrupt.
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PDF描述
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