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參數資料
| 型號： | ISPLSI 2032VE-180LTN44 |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數： | 13/16頁 |
| 文件大小： | 0K |
| 描述： | IC PLD ISP 32I/O 5NS 44TQFP |
| 標準包裝： | 160 |
| 系列： | ispLSI® 2000VE |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 5.0ns |
| 電壓電源 - 內部： | 3 V ~ 3.6 V |
| 邏輯元件/邏輯塊數目： | 8 |
| 宏單元數： | 32 |
| 門數： | 1000 |
| 輸入/輸出數： | 32 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-TQFP |
| 供應商設備封裝： | 44-TQFP（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | ISPLSI2032VE-180LTN44 |
Specifications ispLSI 2032VE
5
USE
2032VE-300
FOR
NEW
DESIGNS
External Timing Parameters
Over Recommended Operating Conditions
tpd1
UNITS
TEST
COND.
1. Unless noted otherwise, all parameters use a GRP load of 4, 20 PTXOR path, ORP and Y0 clock.
2. Standard 16-bit counter using GRP feedback.
3. Reference Switching Test Conditions section.
Table 2-0030A/2032VE
v.0.1
1
3
2
1
tsu2 + tco1
(
)
DESCRIPTION
#
PARAMETER
A
1
Data Propagation Delay, 4PT Bypass, ORP Bypass
ns
tpd2
A
2
Data Propagation Delay
ns
fmax
A
3
Clock Frequency with Internal Feedback
MHz
fmax (Ext.)
–
4
Clock Frequency with External Feedback
MHz
fmax (Tog.)
–
5
Clock Frequency, Max. Toggle
MHz
tsu1
–
6
GLB Reg. Setup Time before Clock, 4 PT Bypass
ns
tco1
A
7
GLB Reg. Clock to Output Delay, ORP Bypass
ns
th1
–
8
GLB Reg. Hold Time after Clock, 4 PT Bypass
ns
tsu2
–
9
GLB Reg. Setup Time before Clock
ns
tco2
A
10
GLB Reg. Clock to Output Delay
ns
th2
–
11
GLB Reg. Hold Time after Clock
ns
tr1
A
12
Ext. Reset Pin to Output Delay, ORP Bypass
ns
trw1
–
13
Ext. Reset Pulse Duration
ns
tptoeen
B
14
Input to Output Enable
ns
tptoedis
C
15
Input to Output Disable
ns
tgoeen
B
16
Global OE Output Enable
ns
tgoedis
C
17
Global OE Output Disable
ns
twh
–
18
External Synchronous Clock Pulse Duration, High
ns
twl
–
19
External Synchronous Clock Pulse Duration, Low
ns
-225
MIN. MAX.
–
4.0
–
225
–
0.0
3.5
–
0.0
–
3.5
–
2.0
–
2.0
–
154
250
2.5
3.0
–
4.0
–
5.0
–
7.0
3.5
6.0
-300
MIN. MAX.
–
3.0
–
300
–
0.0
2.8
–
0.0
–
3.0
–
1.5
–
1.5
–
208
333
2.0
–
2.5
–
4.5
–
5.0
3.0
4.5
SELECT
DEVICES
DISCONTINUED
相關PDF資料 |
PDF描述 |
|---|---|
| TAP474K035BRS | CAP TANT 0.47UF 35V 10% RADIAL |
| ABM31DRMT | CONN EDGECARD 62POS .156 WW |
| TAP335K016CRS | CAP TANT 3.3UF 16V 10% RADIAL |
| HSC30DRYN-S93 | CONN EDGECARD 60POS DIP .100 SLD |
| LC4032B-25TN48C | IC CPLD 32MACROCELLS 48TQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ISPLSI2032VE-180LTN44 | 功能描述:CPLD - 復雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI2032VE180LTN44I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V In-System Programmable High Density SuperFAST⑩ PLD |
| ISPLSI2032VE-180LTN44I | 功能描述:CPLD - 復雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI2032VE180LTN48 | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V In-System Programmable High Density SuperFAST⑩ PLD |
| ispLSI2032VE-180LTN48 | 功能描述:CPLD - 復雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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