參數(shù)資料
型號： ICS8545BGLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 1/10頁
文件大小： 0K
描述： IC CLOCK BUFFER MUX 2:4 20-TSSOP
標準包裝： 74
系列： HiPerClockS™
類型： 扇出緩沖器（分配），多路復用器
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 無/是
輸入： LVCMOS，LVTTL
輸出： LVDS
頻率 - 最大： 650MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
供應商設(shè)備封裝： 20-TSSOP
包裝： 管件
其它名稱： 8545BGLF
ICS8545BGLF-ND
LOW SKEW, 1-TO-4 LVCMOS/LVTTL-TO-LVDS
FANOUT BUFFER
ICS8545
IDT / ICS LVDS FANOUT BUFFER
1
ICS8545BG REV. D OCTOBER 28, 2008
Description
The ICS8545 is a low skew, high performance 1-to-4
LVCMOS/LVTTL-to-LVDS Clock Fanout Buffer and a
member of the HiPerClockS family of High
Performance Clock Solutions from IDT. Utilizing Low
Voltage Differential Signaling (LVDS) the ICS8545
provides a low power, low noise, solution for distributing clock
signals over controlled impedances of 100
. The ICS8545
accepts a LVCMOS/LVTTL input level and translates it to 3.3V
LVDS output levels.
Guaranteed output and part-to-part skew characteristics make the
ICS8545 ideal for those applications demanding well defined
performance and repeatability.
Features
Four differential LVDS output pairs
Two LVCMOS/LVTTL clock inputs to support redundant
or selectable frequency fanout applications
Maximum output frequency: 650MHz
Translates LVCMOS/LVTTL input signals to LVDS levels
Output skew: 40ps (maximum)
Part-to-part skew: 500ps (maximum)
Propagation delay: 3.6ns (maximum)
Additive phase jitter, RMS: 0.13ps (typical)
Full 3.3Vsupply mode
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
ICS85
45
20-Lead TSSOP
6.5mm x 4.4mm x 0.925
mm
package body
G Package
Top View
Pin Assignment
Block Diagram
0
1
nD
Q
LE
0
1
Q0
Q1
Q2
Q3
LK_EN
CLK1
CLK2
K_SEL
OE
Pulldown
Pullup
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
GND
OE
nc
CLK2
nc
CLK1
CLK_SEL
CLK_EN
GND
VDD
Q0
VDD
Q1
Q2
GND
Q3
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PDF描述
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參數(shù)描述
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