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參數(shù)資料
| 型號： | HYB18T512800AF-37 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 512-Mbit Double-Data-Rate-Two SDRAM |
| 中文描述： | 512兆雙數(shù)據(jù)速率2內(nèi)存 |
| 文件頁數(shù)： | 70/96頁 |
| 文件大?。?/td> | 1571K |
| 代理商： | HYB18T512800AF-37 |
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HYB18T512[400/800/160]A[C/F]–[3.7/5]
512-Mbit Double-Data-Rate-Two SDRAM
AC & DC Operating Conditions
Data Sheet
70
Rev. 1.13, 2004-05
09112003-SDM9-IQ3P
Figure 64
Differential DC and AC Input and Output Logic Levels Diagram
Table 26
Symbol
V
IN(dc)
V
ID(dc)
V
ID(ac
)
V
IX(ac)
Differential DC and AC Input and Output Logic Levels
Parameter
DC input signal voltage
DC differential input voltage
AC differential input voltage
AC differential cross point input
voltage
AC differential cross point output
voltage
Min.
–0.3
0.25
0.5
0.5
×
V
DDQ
– 0.175
Max.
V
DDQ
+ 0.3
V
DDQ
+ 0.6
V
DDQ
+ 0.6
0.5
×
V
DDQ
+ 0.175
Units
Notes
1)
1)
V
IN(dc)
specifies the allowable DC execution of each input of differential pair such as CK, CK, DQS, DQS etc.
2)
V
ID(dc)
specifies the input differential voltage
V
TR
–
V
CP
required for switching. The minimum value is equal to
V
IH(dc)
–
V
IL(dc)
.
3)
V
ID(ac)
specifies the input differential voltage
V
TR
–
V
CP
required for switching. The minimum value is equal to
V
IH(ac)
–
V
IL(ac)
.
4) The value of
V
IX(ac)
is expected to equal 0.5
×
V
DDQ
of the transmitting device and
V
IX(ac)
is expected to track variations in
V
DDQ
.
V
IX(ac)
indicates the voltage at which differential input signals must cross.
5) The value of
V
OX(ac)
is expected to equal 0.5
×
V
DDQ
of the transmitting device and
V
OX(ac)
is expected to track variations in
V
DDQ
.
V
OX(ac)
indicates the voltage at which differential input signals must cross.
2)
V
V
3)
4)
V
OX(ac)
0.5
×
V
DDQ
– 0.125
0.5
×
V
DDQ
+ 0.125
V
5)
Crossing Point
VDDQ
VSSQ
VID
VIX or VOX
VTR
VCP
SSTL18_3
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PDF描述 |
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