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參數(shù)資料
| 型號(hào)： | DS33ZH11 |
| 廠商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | Ethernet Mapper |
| 中文描述： | DATACOM, NETWORK INTERFACE SUPPORT CIRCUIT, PBGA100 |
| 封裝： | 10 X 10 MM, 1.41 MM HEIGHT, 0.80 MM PITCH, CSBGA-100 |
| 文件頁數(shù)： | 75/169頁 |
| 文件大?。?/td> | 1049K |
| 代理商： | DS33ZH11 |
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DS33Z11 Ethernet Mapper
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit 4: Receive Serial Interface Clock Activity Latched Status 1 (RLCALS1)
This bit is set to 1 if the receive
clock for Serial Interface 1 has activity. This bit is cleared upon read.
Bit 0: Transmit Serial Interface Clock Activity Latched Status 1 (TSCALS1)
This bit is set to 1 if the transmit
clock for Serial Interface 1 has activity. This bit is cleared upon read.
Register Name:
GL.SRCALS
Register Description:
Global SDRAM Reference Clock Activity Latched Status
Register Address:
05h
Bit #
7
6
5
4
Name
-
-
-
-
Default
-
-
-
-
Bit 1: Reference Clock Activity Latched Status
(REFCLKS)
This bit is set to 1 if REF_CLK has activity. This bit
is cleared upon read.
Bit 0: System Clock Input Latched Status
(SYSCLS)
This bit is set to 1 if SYSCLKI has activity. This bit is
cleared upon read.
75 of 169
GL.RTCAL
Global Receive and Transmit Serial Port Clock Activity Latched Status
04h
7
-
-
6
-
-
5
-
-
4
3
-
-
2
-
-
1
-
-
0
RLCALS1
-
TLCALS1
-
3
-
-
2
-
-
1
0
REFCLKS
-
SYSCLS
-
Register Name:
Register Description:
Register Address:
GL.LIE
Global Serial Interface Interrupt Enable
06h
Bit #
Name
Default
7
-
0
6
-
0
5
-
0
4
3
-
0
2
-
0
1
-
0
0
LIN1TIE
0
LIN1RIE
0
Bit 4: Serial Interface 1 TX Interrupt Enable (LINE1TIE)
Setting this bit to 1 enables an interrupt on LIN1TIS
Bit 0: Serial Interface 1 RX Interrupt Enable (LINE1RIE)
Setting this bit to 1 enables an interrupt on LIN1RIS
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PDF描述 |
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參數(shù)描述 |
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