參數(shù)資料
型號(hào)： DS21352L
英文描述： 3.3V DS21352 and 5V DS21552 T1 Single-Chip Transceivers
中文描述： 3.3 DS21352及5V DS21552 T1單芯片收發(fā)器
文件頁(yè)數(shù)： 134/137頁(yè)
文件大?。?/td> 1094K
代理商： DS21352L
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DS21352/DS21552
134 of 137
AC CHARACTERISTICS –
TRANSMIT SIDE
[See Figure 24-11 to Figure 24-13]
PARAMETER
TCLK Period
TCLK Pulse Width
(0 C to 70 C; V
DD
= 3.3V 5% for DS21352L;
0 C to 70 C; V
DD
= 5.0V 5% for DS21552L;
-40 C to +85 C; V
DD
= 3.3V 5% for DS21352LN;
-40 C to +85 C; V
DD
= 5.0V 5% for DS21552LN)
TYP
MAX
648
SYMBOL
t
CP
t
CH
t
CL
t
LP
t
LH
t
LL
t
SP
t
SP
t
SP
t
SP
t
SH
t
SL
t
SU
MIN
UNITS
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
NOTES
75
75
TCLKI Period
TCLKI Pulse Width
648
75
75
100
100
100
100
50
50
20
TSYSCLK Period
648
488
244
122
1
2
3
4
TSYSCLK Pulse Width
TSYNC or TSSYNC Set Up to TCLK
or TSYSCLK falling
TSYNC or TSSYNC Pulse Width
TSER, TSIG, TDATA, TLINK,
TPOSI, TNEGI Set Up to TCLK,
TSYSCLK, TCLKI Falling
TSER, TSIG, TDATA, TLINK,
TPOSI, TNEGI Hold from TCLK,
TSYSCLK, TCLKI Falling
TCLK, TCLKI or TSYSCLK Rise and
Fall Times
Delay TCLKO to TPOSO, TNEGO
Valid
Delay TCLK to TESO Valid
Delay TCLK to TCHBLK, TCHCLK,
TSYNC, TLCLK
Delay TSYSCLK to TCHCLK,
TCHBLK, CO
CI Set Up to TSYSCLK Rising
CI Pulse Width
t
CH
–5 or
t
SH
–5
t
PW
t
SU
50
20
ns
ns
t
HD
20
ns
t
R
, t
F
25
ns
t
DD
50
ns
t
D1
t
D2
50
50
ns
ns
t
D3
75
ns
t
SC
t
WC
20
50
ns
ns
NOTES:
1. TSYSCLK = 1.544 MHz.
2. TSYSCLK = 2.048 MHz.
3. TSYSCLK = 4.096 MHz
4. TSYSCLK = 8.192 MHz
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PDF描述
DS21352LN 3.3V DS21352 and 5V DS21552 T1 Single-Chip Transceivers
DS21552L 3.3V DS21352 and 5V DS21552 T1 Single-Chip Transceivers
DS21552LN 3.3V DS21352 and 5V DS21552 T1 Single-Chip Transceivers
DS21354 MTTF is frequently used interchangeably with MTBF
DS21354L 3.3V/5V E1 Single-Chip Transceivers
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參數(shù)描述
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DS21352LB 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T1 Single Chip Transceivers RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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