參數(shù)資料
型號(hào)： CDB4272
廠商： Cirrus Logic, Inc.
元件分類： Codec
英文描述： 24-Bit, 192 kHz Stereo Audio CODEC
中文描述： 24位192千赫立體聲音頻CODEC
文件頁(yè)數(shù)： 22/53頁(yè)
文件大?。?/td> 1200K
代理商： CDB4272
CS4272
22
DS593F1
SWITCHING CHARACTERISTICS - SPI CONTROL PORT
(Inputs: logic 0 = AGND, logic 1 = VL)
Notes: 24.
t
spi
only needed before first falling edge of CS after RST rising edge. t
spi
= 0 at all other times.
Data must be held for sufficient time to bridge the transition time of CCLK.
For F
SCK
< 1 MHz
25.
26.
Parameter
Symbol
Min
Max
Unit
SPI Mode
CCLK Clock Frequency.
f
sclk
t
srs
t
spi
t
csh
t
css
t
scl
t
sch
t
dsu
t
dh
t
r2
t
f2
-
6
MHz
RST Rising Edge to CS Falling.
500
-
ns
CCLK Edge to CS Falling.
(Note 24)
500
-
ns
CS High Time Between Transmissions.
1.0
-
μs
CS Falling to CCLK Edge.
20
-
ns
CCLK Low Time.
82
-
ns
CCLK High Time.
82
-
ns
CDIN to CCLK Rising Setup Time.
40
-
ns
CCLK Rising to DATA Hold Time.
(Note 25)
15
-
ns
Rise Time of CCLK and CDIN.
(Note 26)
-
100
ns
Fall Time of CCLK and CDIN.
(Note 26)
-
100
ns
tr2
tf2
t
dsu
t
dh
t
sch
tscl
CS
CCLK
CDIN
tcss
t
csh
tspi
tsrs
RST
Figure 7. SPI Control Port Timing
相關(guān)PDF資料
PDF描述
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