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參數(shù)資料
| 型號： | CDB4228 |
| 廠商： | Cirrus Logic, Inc. |
| 元件分類： | Codec |
| 英文描述： | 24-Bit, 96 kHz Surround Sound Codec |
| 中文描述： | 24位96千赫環(huán)繞聲解碼器 |
| 文件頁數(shù)： | 9/30頁 |
| 文件大?。?/td> | 487K |
| 代理商： | CDB4228 |
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CS4228
DS307PP1
9
SWITCHING CHARACTERISTICS - CONTROL PORT
(T
A
= 25°C; VD = VL = +3.3V,
VA = +5V; Inputs: logic 0 = DGND, logic 1 = VL, C
L
= 30 pF)
Parameter
I
2
C
Mode
(SDOUT < 47k
to ground)
(Note 11)
SCL Clock Frequency
Bus Free Time Between Transmissions
Start Condition Hold Time (prior to first clock pulse)
Clock Low Time
Clock High Time
Setup Time for Repeated Start Condition
SDA Hold Time from SCL Falling
(Note 12)
SDA Setup Time to SCL Rising
Rise Time of Both SDA and SCL Lines
Fall Time of Both SDA and SCL Lines
Setup Time for Stop Condition
Notes: 11.
Use of the I
2
C bus interface requires a license from Philips. I
2
C is a registered trademark of Philips
Semiconductors.
Data must be held for sufficient time to bridge the 300 ns transition time of SCL.
12.
Symbol
Min
Max
Units
f
scl
t
buf
t
hdst
t
low
t
high
t
sust
t
hdd
t
sud
t
r
t
f
t
susp
-
100
kHz
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
ns
μ
s
ns
μ
s
4.7
4.0
4.7
4.0
4.7
0
250
1
300
4.7
t
buf
thdst
t
hdst
t
low
t
r
t
f
t
hdd
thigh
t
sud
t
sust
t
susp
Stop
Start
Start
Stop
Repeated
SDA
SCL
Figure 4. I
2
C Control Port Timing
相關PDF資料 |
PDF描述 |
|---|---|
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| CDB42426 | 114 dB, 192kHz 6-Ch CODEC WITH PLL |
| CDB42428 | 114 dB, 192kHz 8-Ch CODEC WITH PLL |
| CDB42438 | 108 dB, 192 kHz 4-in, 6-out TDM CODEC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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