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參數(shù)資料
| 型號： | CDB4228 |
| 廠商： | Cirrus Logic, Inc. |
| 元件分類： | Codec |
| 英文描述： | 24-Bit, 96 kHz Surround Sound Codec |
| 中文描述： | 24位96千赫環(huán)繞聲解碼器 |
| 文件頁數(shù)： | 7/30頁 |
| 文件大?。?/td> | 487K |
| 代理商： | CDB4228 |
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CS4228
DS307PP1
7
SWITCHING CHARACTERISTICS
(Continued)
Notes: 8.
After powering up the CS4228, RST should be held low until the power supplies and clocks are settled.
Parameter
Symbol
Typ
-
-
-
-
-
Max
-
TBD
TBD
TBD
TBD
Units
ms
ns
ns
ns
ns
RST Low Time
SCLK Falling Edge to SDOUT Output Valid
LRCK Edge to MSB Valid
SDIN Setup Time Before SCLK Rising Edge
SDIN Hold Time After SCLK Rising Edge
Master Mode
SCLK Falling to LRCK Edge
SCLK Duty Cycle
Slave Mode
SCLK Period
SCLK High Time
SCLK Low Time
SCLK rising to LRCK Edge
LRCK Edge to SCLK Rising
(Note 8)
(DSCK=0)
1
t
dpd
t
lrpd
t
ds
t
dh
t
mslr
+10
50
-
-
ns
%
t
sckw
t
sckh
t
sckl
t
lrckd
t
lrcks
-
-
-
-
-
-
-
-
-
-
ns
ns
ns
ns
ns
TBD
TBD
TBD
TBD
(DSCK=0)
(DSCK=0)
Figure 1. Serial Audio Port Master Mode Timing
t
mslr
SCLK*
(output)
LRCK
(output)
SDOUT
sckh
sckl
sckw
t
t
t
MSB
MSB-1
*SCLK shown for DSCK = 0.
SCLK inverted for DSCK = 1.
t
dpd
SDOUT
LRCK
(input)
SCLK*
(input)
SDIN1
SDIN2
SDIN3
dh
t
ds
t
lrpd
t
lrcks
t
lrckd
t
Figure 2. Serial Audio Port Slave Mode Timing
相關PDF資料 |
PDF描述 |
|---|---|
| CDB42416 | 110 dB, 192kHz 6-Ch CODEC WITH PLL |
| CDB42418 | 110 dB, 192kHz 8-Ch CODEC WITH PLL |
| CDB42426 | 114 dB, 192kHz 6-Ch CODEC WITH PLL |
| CDB42428 | 114 dB, 192kHz 8-Ch CODEC WITH PLL |
| CDB42438 | 108 dB, 192 kHz 4-in, 6-out TDM CODEC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| CDB42416 | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:110 dB, 192kHz 6-Ch CODEC WITH PLL |
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