參數(shù)資料
型號(hào)： CDB391A
廠商： Cirrus Logic, Inc.
英文描述： 24-BIT, 192 kHz STEREO DAC WITH VOLUME CONTROL
中文描述： 24位192千赫立體聲DAC控制音量
文件頁(yè)數(shù)： 12/40頁(yè)
文件大小： 748K
代理商： CDB391A
CS4391A
12
DS600PP3
SWITCHING CHARACTERISTICS - SPI CONTROL PORT
(Inputs: logic 0 = AGND,
logic 1 = VL)
Notes: 8.
t
spi
only needed before first falling edge of CS after RST rising edge. t
spi
= 0 at all other times.
Data must be held for sufficient time to bridge the transition time of CCLK.
10. For F
SCK
< 1 MHz
9.
Parameter
Symbol
Min
Max
Unit
SPI Mode
CCLK Clock Frequency
f
sclk
t
srs
t
spi
t
csh
t
css
t
scl
t
sch
t
dsu
t
dh
t
r2
t
f2
-
6
MHz
RST Rising Edge to CS Falling
500
-
ns
CCLK Edge to CS Falling
(Note 8)
500
-
ns
CS High Time Between Transmissions
1.0
-
μs
CS Falling to CCLK Edge
20
-
ns
CCLK Low Time
66
-
ns
CCLK High Time
66
-
ns
CDIN to CCLK Rising Setup Time
40
-
ns
CCLK Rising to DATA Hold Time
(Note 9)
15
-
ns
Rise Time of CCLK and CDIN
(Note 10)
-
100
ns
Fall Time of CCLK and CDIN
(Note 10)
-
100
ns
tr2
tf2
t
dsu
t
dh
tsch
tscl
CS
CCLK
CDIN
tcss
tcsh
tspi
tsrs
RST
Figure 4. SPI Control Port Timing
相關(guān)PDF資料
PDF描述
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CDB4216 16-Bit Stereo Audio Codec
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CDB4221 24-Bit Stereo Audio Codec with 3V Interface
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