參數(shù)資料
型號： ATF1504ASVL-20JC44
廠商： ATMEL CORP
元件分類： PLD
英文描述： Low-voltage, Complex Programmable Logic Device
中文描述： EE PLD, 20 ns, PQCC44
封裝： PLASTIC, MS-018AC, LCC-44
文件頁數(shù)： 11/21頁
文件大?。?/td> 462K
代理商： ATF1504ASVL-20JC44
ATF1504ASZ
11
Notes:
1. See ordering information for valid part numbers.
2. The t
RPA
parameter must be added to the t
LAD
, t
LAC
,t
TIC
, t
ACL
, and t
SEXP
parameters for macrocells running in the reduced-
power mode.
AC Characteristics
(Continued)
Symbol
Parameter
-7
-10
-15
-20
-25
Units
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
t
ZX1
Output Buffer Enable Delay
(Slow slew rate = OFF;
V
CCIO
= 5.0V; C
L
= 35 pF)
4.0
5.0
7
9
10
ns
t
ZX2
Output Buffer Enable Delay
(Slow slew rate = OFF;
V
CCIO
= 3.3V; C
L
= 35 pF)
4.5
5.5
7
9
10
ns
t
ZX3
Output Buffer Enable Delay
(Slow slew rate = ON;
V
CCIO
= 5.0V/3.3V; C
L
= 35 pF)
9
9
10
11
12
ns
t
XZ
Output Buffer Disable Delay
(C
L
= 5 pF)
4
5
6
7
8
ns
t
SU
Register Setup Time
3
3
4
5
6
ns
t
H
Register Hold Time
2
3
4
5
6
ns
t
FSU
Register Setup Time of Fast Input
3
3
2
2
3
ns
t
FH
Register Hold Time of Fast Input
0.5
0.5
2
2
2.5
ns
t
RD
Register Delay
1
2
1
2
2
ns
t
COMB
Combinatorial Delay
1
2
1
2
2
ns
t
IC
Array Clock Delay
3
5
6
7
8
ns
t
EN
Register Enable Time
3
5
6
7
8
ns
t
GLOB
Global Control Delay
1
1
1
1
1
ns
t
PRE
Register Preset Time
2
3
4
5
6
ns
t
CLR
Register Clear Time
2
3
4
5
6
ns
t
UIM
Switch Matrix Delay
1
1
2
2
2
ns
t
RPA
Reduced-Power Adder
(2)
10
11
13
14
15
ns
Input Test Waveforms and
Measurement Levels
t
R
, t
F
= 1.5 ns typical
Output AC Test Loads
Note:
*Numbers in parenthesis refer to 3.0V operating condi-
tions (preliminary).
(3.0V)*
(703 )*
(8060 )*
= Preliminary Information
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PDF描述
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ATF1504ASL-20JC44 ER 2C 2#8 SKT RECP
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