Synchronous Read/Write—Bus Slave See Table 13 and Figure 16. Use these specifications for ADSP- 21160N bus master acces" />
參數(shù)資料
型號(hào)： ADSP-21160NKB-100
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 18/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 32BIT 400BGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類(lèi)型： 浮點(diǎn)
接口： 主機(jī)接口，連接端口，串行端口
時(shí)鐘速率： 100MHz
非易失內(nèi)存： 外部
芯片上RAM： 512kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.90V
工作溫度： 0°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤(pán)
–25–
REV. 0
ADSP-21160N
Synchronous Read/Write—Bus Slave
See Table 13 and Figure 16. Use these specifications for ADSP-
21160N bus master accesses of a slave’s IOP registers or internal
memory (in multiprocessor memory space). The bus master
must meet these (bus slave) timing requirements.
Table 13. Synchronous Read/Write—Bus Slave
Parameter
Min
Max
Unit
Timing Requirements
tSADDI
Address, BRST Setup Before CLKIN
5
ns
tHADDI
Address, BRST Hold After CLKIN
1
ns
tSRWI
RDx/WRx Setup Before CLKIN
5
ns
tHRWI
RDx/WRx Hold After CLKIN
1ns
tSSDATI
Data Setup Before CLKIN
5.5
ns
tHSDATI
Data Hold After CLKIN
1
ns
Switching Characteristics
tDDATO
Data Delay After CLKIN
0.25 tCCLK + 9
ns
tHDATO
Data Hold After CLKIN
1.5
ns
tDACKC
ACK Delay After CLKIN
10
ns
tHACKO
ACK Hold After CLKIN
1.5
ns
Figure 16. Synchronous Read/Write—Bus Slave
CLKIN
ADDRESS
ACK
RDx
DATA
(OUT)
WRx
WRITE ACCESS
DATA
(IN)
READ ACCESS
tSADDI
tHADDI
tDACKC
tHACKO
tHRWI
tSRWI
tDDATO
tHDATO
tSRWI
tHRWI
tHSDATI
tSSDATI
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