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參數(shù)資料
| 型號(hào)： | IDT79RC32K438-233BBI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/59頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 32BIT CORE 233MHZ 416-BGA |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | Interprise™ |
| 處理器類型： | MIPS32 32-位 |
| 速度： | 233MHz |
| 電壓： | 1.2V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 416-BGA |
| 供應(yīng)商設(shè)備封裝： | 416-PBGA（27x27） |
| 包裝： | 托盤 |
| 其它名稱： | 79RC32K438-233BBI |
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May 25, 2004
IDT 79RC32438
Pin Characteristics
Note: Some input pads of the RC32438 do not contain internal pull-ups or pull-downs. Unused inputs should be tied off to appropriate
levels. This is especially critical for unused control signal inputs (such as BRN) which, if left floating, could adversely affect the RC32438’s
operation. Also, any input pin left floating can cause a slight increase in power consumption.
JTAG_TRST_N
I
JTAG Reset. This active low signal asynchronously resets the boundary scan
logic, JTAG TAP Controller, and the EJTAG Debug TAP Controller. An external
pull-up on the board is recommended to meet the JTAG specification in cases
where the tester can access this signal. However, for systems running in func-
tional mode, one of the following should occur:
1) actively drive this signal low with control logic
2) statically drive this signal low with an external pull-down on the board
3) clock JTAG_TCK while holding EJTAG_TMS and/or JTAG_TMS high.
Debug
CPU
O
CPU Transaction. This signal is asserted during all CPU instruction fetches and
data transfers to/from the DDR and devices on the memory and peripheral bus.
The signal is negated during PCI and DMA transactions to/from the DDR and
devices on the memory and peripheral bus.
INST
O
Instruction or Data. This signal is driven high during CPU instruction fetches on
the memory and peripheral bus memory or DDR bus.
Function
Pin Name
Type
Buffer
I/O Type
Internal
Resistor
Notes1
Memory and
Peripheral Bus
BDIRN
O
LVTTL
High Drive
BGN
O
LVTTL
Low Drive
BOEN
O
LVTTL
High Drive
BRN
I
LVTTL
STI2
pull-up
BWEN[1:0]
O
LVTTL
High Drive
CSN[5:0]
O
LVTTL
High Drive
MADDR[21:0]
O
LVTTL
High Drive
MDATA[15:0]
I/O
LVTTL
High Drive
OEN
O
LVTTL
High Drive
RWN
O
LVTTL
High Drive
WAITACKN
I
LVTTL
STI
pull-up
Table 2 Pin Characteristics (Part 1 of 4)
Signal
Type
Name/Description
Table 1 Pin Description (Part 9 of 9)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| AD8066ARZ | 功能描述:IC OPAMP VF R-R DUAL LN LP 8SOIC RoHS:是 類別:集成電路 (IC) >> Linear - Amplifiers - Instrumentation 系列:FastFET™ 標(biāo)準(zhǔn)包裝:2,500 系列:- 放大器類型:通用 電路數(shù):4 輸出類型:- 轉(zhuǎn)換速率:0.6 V/µs 增益帶寬積:1MHz -3db帶寬:- 電流 - 輸入偏壓:45nA 電壓 - 輸入偏移:2000µV 電流 - 電源:1.4mA 電流 - 輸出 / 通道:40mA 電壓 - 電源，單路/雙路(±):3 V ~ 32 V，±1.5 V ~ 16 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:14-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:14-TSSOP 包裝:帶卷 (TR) 其它名稱:LM324ADTBR2G-NDLM324ADTBR2GOSTR |
| AD8066ARZ-R7 | 功能描述:IC OPAMP VF R-R DUAL LN LP 8SOIC RoHS:是 類別:集成電路 (IC) >> Linear - Amplifiers - Instrumentation 系列:FastFET™ 標(biāo)準(zhǔn)包裝:100 系列:- 放大器類型:通用 電路數(shù):1 輸出類型:- 轉(zhuǎn)換速率:0.2 V/µs 增益帶寬積:- -3db帶寬:- 電流 - 輸入偏壓:100pA 電壓 - 輸入偏移:30µV 電流 - 電源:380µA 電流 - 輸出 / 通道:- 電壓 - 電源，單路/雙路(±):±2 V ~ 18 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:8-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:8-SO 包裝:管件 |
| AD8066ARZ-RL | 功能描述:IC OPAMP VF R-R DUAL LN LP 8SOIC RoHS:是 類別:集成電路 (IC) >> Linear - Amplifiers - Instrumentation 系列:FastFET™ 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- 放大器類型:電流檢測 電路數(shù):1 輸出類型:- 轉(zhuǎn)換速率:- 增益帶寬積:125kHz -3db帶寬:- 電流 - 輸入偏壓:- 電壓 - 輸入偏移:100µV 電流 - 電源:1.1µA 電流 - 輸出 / 通道:- 電壓 - 電源，單路/雙路(±):- 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:4-WFBGA，CSPBGA 供應(yīng)商設(shè)備封裝:4-UCSP（2x2） 包裝:剪切帶 (CT) 其它名稱:MAX9634WERS+TCT |
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