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參數(shù)資料
| 型號： | 64F2214TE16 |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 47/865頁 |
| 文件大?。?/td> | 2810K |
| 代理商： | 64F2214TE16 |
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106
5.5
Usage Notes
5.5.1
Contention between Interrupt Generation and Disabling
When an interrupt enable bit is cleared to 0 to disable interrupts, the disabling becomes effective
after execution of the instruction.
In other words, when an interrupt enable bit is cleared to 0 by an instruction such as BCLR or
MOV, if an interrupt is generated during execution of the instruction, the interrupt concerned will
still be enabled on completion of the instruction, and so interrupt exception handling for that
interrupt will be executed on completion of the instruction. However, if there is an interrupt
request of higher priority than that interrupt, interrupt exception handling will be executed for the
higher-priority interrupt, and the lower-priority interrupt will be ignored.
The same also applies when an interrupt source flag is cleared to 0.
Figure 5-8 shows and example in which the TGIEA bit in 16-bit timer TIER0 is cleared to 0.
Internal
address bus
Internal
write signal
TGIEA
TGFA
TGIOA
interrupt signal
TIER0 write cycle by CPU
TGIOA exception handling
TIER0 address
Figure 5-8 Contention between Interrupt Generation and Disabling
The above contention will not occur if an enable bit or interrupt source flag is cleared to 0 while
the interrupt is masked.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 64F2214TF16 | Microcontroller |
| 651-(SERIES) | Analog IC |
| 652-(SERIES) | Analog IC |
| 652-100 | Analog IC |
| 652206 | Precision, 5V Voltage Reference, Replaced MAX673 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 64F2378AVFQ34V | 制造商: 功能描述: 制造商:undefined 功能描述: |
| 64F3672FX | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi Single-Chip Microcomputer |
| 64F500FA383 | 制造商:Arcolectric 功能描述: |
| 64F500FA413 | 制造商:Arcolectric 功能描述: |
| 64F500FC233 | 制造商:Arcolectric 功能描述: |
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