參數(shù)資料
型號(hào)： 554DC000159DGR
廠商： SILICON LABORATORIES
元件分類(lèi)： VCXO, clock
英文描述： VCXO, CLOCK, ECL OUTPUT
封裝： ROHS COMPLIANT PACKAGE-8
文件頁(yè)數(shù)： 9/14頁(yè)
文件大小： 238K
代理商： 554DC000159DGR
Si554
4
Rev. 0.6
Table 5. CLK± Output Phase Jitter
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
Phase Jitter (RMS)1,2,3
for FOUT > 500 MHz
φ
J
Kv = 33 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.26
—
ps
Kv = 45 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.27
0.26
—
Kv = 90 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.32
0.26
—
Kv = 135 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.40
0.27
—
Kv = 180 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.49
0.28
—
Kv = 356 ppm/V
12 kHz to 20 MHz (OC-48)
50 kHz to 80 MHz (OC-192)
—
0.87
0.33
—
Notes:
1. Differential Modes: LVPECL/LVDS/CML. Refer to AN255, AN256, and AN266 for further information.
2. For best jitter and phase noise performance, always choose the smallest KV that meets the application’s minimum APR
requirements. See “AN266: VCXO Tuning Slope (KV), Stability, and Absolute Pull Range (APR)” for more information.
3. See “AN255: Replacing 622 MHz VCSO devices with the Si550 VCXO” for comparison highlighting power supply
rejection (PSR) advantage of Si55x versus SAW-based solutions.
相關(guān)PDF資料
PDF描述
571BCB000105DG VCXO, CLOCK, 10 MHz - 810 MHz, LVDS OUTPUT
5G42D-80M-FREQ VCXO, CLOCK, 1 MHz - 50 MHz, HCMOS/TTL OUTPUT
5G576C-80T-FREQ VCXO, CLOCK, 0.625 MHz - 50 MHz, HCMOS/TTL OUTPUT
5G14E-80M-50.000 VCXO, CLOCK, 50 MHz, CMOS/TTL OUTPUT
5G536A-80N-1.000 VCXO, CLOCK, 1 MHz, CMOS/TTL OUTPUT
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
554DC000212BG 制造商:Silicon Laboratories Inc 功能描述:
554DC000212DG 制造商:Silicon Laboratories Inc 功能描述:
554DC000212DGR 制造商:Silicon Laboratories Inc 功能描述:
554DC000219DG 制造商:Silicon Laboratories Inc 功能描述:
554DC000219DGR 制造商:Silicon Laboratories Inc 功能描述:
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